ホーム : 日本ローカル情報 : EDS2002 出展のご案内
 
     

Electronic Design and Solution Fair 2002

 
US イベントニュース
  US セミナ
  US セミナのアーカイブ
  US イベントスケジュール2001年
 
 
 
 
 
 

ザイリンクスでは Xilinx Everywhere をテーマに、ザイリンクス テクノロジが皆様の身近な存在として幅広いアプリケーションで活用されていることをご紹介いたしました。

展示コーナーでは、新製品はもとより主力製品であるVirtex, Spartan, CPLD製品をご紹介し、お客様の日々の設計・開発のヒントになる情報をお届けしました。またブース内に設置したシアターでは、ザイリンクス各プロダクトおよびザイリンクスをご支援くださるパートナ様各社によるプレゼンテーションを行いました。

EDSF2002 Image
   

【ザイリンクス関連 カンファレンスプログラム 】(アネックスホール)

セッション8 (トラック B)

1月25日(金)12:50-14:20
CPU/DSP混載FPGAの設計応用
講師:熊本大学 末吉敏則 教授
ザイリンクス 荒井 雅

セッション9 (トラック A)
1月25日(金)15:20-16:50
FPGA/PLD設計のためのツールとその効果的な使い方
講師: セイコーインスツルメンツ株式会社 片岡 弘行 氏
コニカ株式会社 佐藤 幸一 氏

【 ザイリンクスシアター タイムテーブル(敬称略)】

1月24日(木)
1月25日(金)
10:30-10:50

Synplicity's Solution in ISE4.1i

シンプリシティ

「Advanced Solution by using IPs on FPGA」市場競争力の強い製品創出に貢献するIPの活用方法

ローラン (ダイヘン)

11:00-11:20

Next Generation for DSP Design with Xilinx FPGA & MATLAB/ Simulink

サイバネット システム

業界最速のソフトプロセッサソリューション -MicroBlaze-

ザイリンクス

11:30-11:50

ヒューリスティック・シンセシスの威力

メンター・グラフィックス・ジャパン

ヒューリスティック・シンセシスの威力

メンター・グラフィックス・ジャパン

12:00-12:20

シノプシスのASIC・FPGAの大規模SoC設計環境に対するソリューション

日本シノプシス

ケイデンス社の機能検証ソリューションのご紹介

日本ケイデンス・デザイン・システムズ

12:30-12:50

ISE 4.1i 設計高速化とEDA新機能

ザイリンクス

シノプシスのASIC・FPGAの大規模SoC設計環境に対するソリューション

日本シノプシス

13:00-13:20

Agilent ADSによる XILINX信号処理用IPコアのシステムレベル検証 -WLAN ( IEEE802.11a ) への応用-

アジレント・テクノロジー

Synplicity's Solution in ISE4.1i

シンプリシティ

13:30-13:50

ザイリンクスDSP設計ツール System Generator ver 2.1

ザイリンクス

ISE 4.1i 設計高速化とEDA新機能

ザイリンクス

14:00-14:20

Soft processors: The next generation development methodology for embedded applications

プロセラー (東京エレクトロンデバイス)

ザイリンクスが贈る高性能・超低消費電力 Real Digital CPLD 次世代 Cool Runner のご紹介

ザイリンクス

14:30-14:50

「Advanced Solution by using IPs on FPGA」市場競争力の強い製品創出に貢献するIPの活用方法

ローラン (ダイヘン)

デジタルコンスーマ向けベストソリューション -SPARTAN-IIE-

ザイリンクス

15:00-15:20

業界最速のソフトプロセッサソリューション -MicroBlaze-

ザイリンクス

最新機能を搭載したPlatform FPGA Virtex-II 製品のご紹介

ザイリンクス

15:30-15:50

ザイリンクスが贈る高性能・超低消費電力 Real Digital CPLD 次世代 Cool Runner のご紹介

ザイリンクス

DK1 and Handel-C: Introducing Software Paradigms to Hardware Design

日本セロックシカ

16:00-16:20

デジタルコンスーマ向けベストソリューション -SPARTAN-IIE-

ザイリンクス

Next Generation for DSP Design with Xilinx FPGA & MATLAB/ Simulink

サイバネット システム

16:30-16:50

最新機能を搭載したPlatform FPGA Virtex-II製品のご紹介

ザイリンクス

ザイリンクスDSP設計ツール System Generator ver 2.1

ザイリンクス

 

 
採用情報 イベント ウェブセミナ プレスリリース IR 情報 フィードバック 法的情報 サイトマップ
© 1994-2008 Xilinx, Inc. All Rights Reserved.