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SEM (ソフト エラー軽減) コア

製品説明

SEM (ソフト エラー軽減) コアは、コンフィギュレーション メモリの SEU 検出、訂正、および分類を行います。このコアは、SEU 検出機能の一環として、ICAP や FRAME_ECC ブロックなどのデバイス プリミティブを使用して、リードバック CRC 回路へクロックを供給して観察します。SEU の訂正では、IP コアが適切な動作を実行して エラーを検出して訂正します。SEU の分類では、IP コアがザイリンクスの「Essential Bit」 テクノロジを使用してシステムの有効性を高めます。

また、SEM IP コアは、コンフィギュレーション メモリにエラーを挿入して、SEU のエミュレーションも実行できます。エラー挿入機能を利用することによって、放射線影響施設にて高価な試験を行わなくても、IP コアの SEU 緩和機能を評価およびテストできます。

UltraScale SEM IP コアの主な機能と利点

  • 高度なシリコン ECC を使用して UltraScale デバイス ファミリをサポート
  • SEU を自動で検出、訂正、分類
  • エラー挿入機能のサポートにより、システム全体を検証可能
  • UART 通信のサポート付きサンプル デザインを含む
  • 最大 200MHz をサポート

SEM IP コアの主な機能と利点

  • Zynq-7000、7 シリーズ、Virtex-6、および Spartan-6 デバイス ファミリをサポート
  • SEU を自動で検出、訂正、分類
  • エラー挿入機能のサポートにより、システム全体を検証可能
  • UART 通信のサポート付きサンプル デザインを含む
  • 最大 100MHz をサポート

ツールおよびデバイスのサポート

デバイス ファミリ サポート:

デザイン ツール サポート:

xilinx-131x43
  • バンドル内容: Vivado Design Suite
    ISE Design Suite
  • ライセンス: Xilinx End User License Agreement
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