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AR# 63477

Vivado DSP ツール (System Generator for DSP) (2014.4) - リリース ノートおよび既知の問題

説明

 

このアンサーでは、System Generator for DSP 2014.4 のリリース ノートおよび既知の問題を示します。

 

ソリューション

このアンサーでは、System Generator for DSP 2014.4 ツールのインストール手順、およびリリース ノートと既知の問題をリストしています。 
 
Vivado Design Suite 2014.4 が正しくインストールされた場合、バージョン番号が 2014.4 に変更されます。
 
System Generator for DSP 2014.4 のリリース ノートおよび新機能
 
2014.4 ツールの新機能の説明およびリリース ノートは、『Vivado Design Suite ユーザー ガイド : リリース ノート、インストールおよびライセンス』 (UG973) を参照してください。
以前のバージョンの System Generator for DSP からの機能や操作方法の変更点は、『System Generator for DSP ユーザー ガイド』 (UG640) を参照してください。 
『Vivado Design Suite ユーザー ガイド : System Generator を使用したモデル ベースの DSP デザイン』 (UG897) は PDF ファイルで、http://japan.xilinx.com/support/documentation/sw_manuals_j/xilinx2014_4/ug897-vivado-sysgen-user.pdf からアクセスできます。
ほかのバージョンの System Generator for DSP のリリース ノートは、(ザイリンクス アンサー 29595) を参照してください。
 
注記 : 2013.1 からの Vivado Design Suite の System Generator を使用したモデル ベースの DSP デザインおよびサポートされる OS および MATLAB バージョンは、(ザイリンクス アンサー 55830) を参照してください。
 
一般
 
(ザイリンクス アンサー 53806) - Vivado System Generator - 古いデザインを使用する方法
(ザイリンクス アンサー 52571) - Vivado System Generator - Vivado SysGen がバックエンドで使用する CORE Generator ツールまたは IP カタログについて
(ザイリンクス アンサー 47623) - Vivado DSP ツール (System Generator for DSP) (2012.1) - System Generator サブモジュールが複数あるデザインのモデルに対してピン ロケーションおよび適用されない制約に関するクリティカル警告メッセージが表示される
(ザイリンクス アンサー 52330) - Vivado System Generator - Vivado System Generator と MATLAB をコンフィギュレーションする方法
(ザイリンクス アンサー 58441) - System Generator for DSP 2013.3 - xlTimingAnalysis エラー
(ザイリンクス アンサー 58175) - 2013.3 System Generator - IP Packager フローでパッケージされた IP の ZIP ファイルが提供されない
(ザイリンクス アンサー 60311) - Vivado System Generator - Vivado System Generator でライセンスがチェックアウトされるタイミング
(ザイリンクス アンサー 56042) - Vivado System Generator - ISE System Generator から Vivado 2012.4 以降に移行すると生成された HDL のピン配置が異なる (2013.1 以降では CE ピンは作成されない)
(ザイリンクス アンサー 53961) - Vivado System Generator - パスの長さが 256 文字を超えている場合 Vivado で IP パッケージャー フローを使用すると合成エラーがいくつか発生する
(ザイリンクス アンサー 57604) - Vivado System Generator 2013.3 - FIR Compiler の reload_tdata_data ポートの小数の幅を設定できない

修正点

(ザイリンクス アンサー 62803) - 2014.3 Vivado Sysgen - DSP48E1 および DSP48 Macro 3.0 の連結機能がシミュレーションで適切に機能しない --> DSP48 Macro のみ 2015.1 で修正 
(ザイリンクス アンサー 62504) - System Generator 2014.3 - 2014.3 で見られる Vivado Viewer 関連問題
(ザイリンクス アンサー 62477) - System Generator 2014.2 & 2014.3 - 浮動小数点型で Assert ブロックを使用するとシミュレーション出力が無効になる
(ザイリンクス アンサー 62388) - 2014.3 System Generator - 波形ビューアーが起動しない
(ザイリンクス アンサー 59236) - 2014.x System Generator - Linux OS で System Generator 2014.x を実行すると、System Generator と Matlab のライブラリに互換性がないために問題が発生する

既知の問題

(ザイリンクス アンサー 63652) - 2014.4 SysGen - ザイリンクス ブロックセットが Simulink ライブラリ ブラウザーに表示されない

(ザイリンクス アンサー 63516) - 2014.x Vivado System Generator - 7 シリーズ デバイスがインストールされていない場合、UltraScale デバイスをターゲットにしたときに System Generator が機能しない  
(ザイリンクス アンサー 63297) - 2014.3/2014.4 Vivado System Generator - DocBlock 問題に起因して表示される「All Xilinx Blocks must be contained in a level of hierarchy with a System Generator Token」というエラー メッセージに対するパッチ
(ザイリンクス アンサー 63044) - 2014.3/4 Vivado System Generator - Vivado シミュレータが呼び出されると Webtalk が原因で System Generator がクラッシュする問題に対処するための緊急パッチ
(ザイリンクス アンサー 62803) - 2014.3 Vivado Sysgen - DSP48E1 および DSP48 Macro 3.0 の連結機能がシミュレーションで適切に機能しない --> DSP48E1 ブロックは 2014.4 で未修正
(ザイリンクス アンサー 63289) - Vivado System Generator 2014.4 - 変換関数を選択して System Generator シミュレーションを実行すると CORDIC IP の大きさの出力が常に 0 になる
(ザイリンクス アンサー 62345) - Vivado System Generator - Redhat 6.x コンピューターでモデルを生成しようとすると、BLAS の読み込みに関連したエラーが出力される
(ザイリンクス アンサー 62328) - Vivado System Generator - MYVIVADO 環境変数が設定されていると、ザイリンクス ブロックまたは System Generator トークンを開いて変更しようとすると Vivado System Generator でエラーが発生する  

(ザイリンクス アンサー 61003) - 2014.1 Vivado System Generator - ModelSim ブロックにより librdi_sysgen_mti_fli_controller.so の読み込みで STL ライブラリ エラーが発生する
(ザイリンクス アンサー 58837) - 2013.3 Vivado System Generator - ModelSim ブロックによって「can't read "vsimPriv(windowmgr)": no such element in array / # ** Error: Tree does not exist」というエラー メッセージが ModelSim コンソールに表示される
(ザイリンクス アンサー 58569) - Vivado 2013.3 System Generator - .mdl ファイルがコピーできない
(ザイリンクス アンサー 58836) - 2013.3 Vivado System Generator - VHDL および Verilog のどちらで記述した Blackbox ブロックでもビヘイビアー シミュレーションでデータ不一致が発生する

AR# 63477
日付 02/23/2015
ステータス アクティブ
種類 一般
ツール
  • System Generator for DSP
  • Vivado Design Suite - 2014.4
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