UPGRADE YOUR BROWSER

We have detected your current browser version is not the latest one. Xilinx.com uses the latest web technologies to bring you the best online experience possible. Please upgrade to a Xilinx.com supported browser:Chrome, Firefox, Internet Explorer 11, Safari. Thank you!

Vivado デザイン ハブ - Vivado - デザインへの制約の適用

日本語版の列に示されている資料によっては、英語版の更新に対応していないものがあります。日本語版は参考用としてご使用の上、最新の情報につきましては、必ず最新英語版をご参照ください。このページに示されている英語版はすべて最新版です。

別のデザイン ハブ ページには右側ペインからアクセスできます。

はじめに

概要 (英語)日本語
 Design Constraints Overview デザイン制約の概要
 Vivado Design Suite Tutorial: Using Constraints 
 Vivado Design Suite Tutorial: I/O and Clock Planning 
キー コンセプト (英語)日本語
 UltraFast Vivado Design Methodology For Timing Closure タイミング クロージャのための UltraFast Vivado 設計手法
 Using the Vivado Timing Constraint Wizard Vivado タイミング制約ウィザードの使用
 Working with Constraint Sets 2017 年夏頃リリース予定です。
 Using the XDC Constraint Editor 2017 年秋頃リリース予定です。
 Creating Basic Clock Constraints 基本的なクロック制約の作成
 Creating Generated Clock Constraints 生成クロック制約の作成
 Setting Multicycle Path Exceptions マルチサイクル パス例外の設定
 Setting False Path Exceptions フォルス パス例外の設定
 Defining Clock Groups and CDC Constraints クロック グループおよび CDC 制約の定義
よくある質問 (FAQ) (英語)日本語
 What Are False and Multicycle Paths, and Why Are They Important? フォルス パス、マルチサイクル パスの概要とその重要性について教えてください。
 Are Timing Constraints Used for Both Synthesis and Implementation? タイミング制約は合成およびインプリメンテーションの両方で使用されますか。
 How Is Setup and Hold Analysis Calculated? セットアップおよびホールド解析はどのように計算されますか。
 Can I Embed Timing Constraints Within my Verilog or VHDL file? Verilog または VHDL ファイルにタイミング制約を含めることは可能ですか。
 Can I Save the Navigable XML Based Timing Report in Vivado like the TWX File in ISE? ISE での TWX ファイルのように誘導可能な XML ベースのタイミング レポートを Vivado で保存する方法を教えてください。
 How Does the Hierarchy Separator "/" Work with the Wildcard Character "*" in XDC and UCF? 階層区切り文字のスラッシュ (/) の XDC と UCF での機能の仕方の違いを教えてください。
 What Kind of Clocks Should be Defined with the create_clock Constraint? どの種類のクロックを create_clock 制約で定義する必要がありますか。
 What Is a Virtual Clock? 仮想クロックとは何ですか。