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Vivado デザイン ハブ - プログラミングおよびデバッグ

日本語版の列に示されている資料によっては、英語版の更新に対応していないものがあります。日本語版は参考用としてご使用の上、最新の情報につきましては、必ず最新英語版をご参照ください。このページに示されている英語版はすべて最新版です。

別のデザイン ハブ ページには右側ペインからアクセスできます。

はじめに

概要 (英語)日本語
 Using Vivado Lab Edition Vivado Lab Edition の使用
 Logic Debug in Vivado Vivado でのハードウェア デバッグ
 Vivado Design Suite Tutorial: Programming and Debugging 
 Vivado Design Suite User Guide: Programming and Debugging Vivado Design Suite ユーザー ガイド: プログラムおよびデバッグ
キー コンセプト (英語)日本語
 How to Use the "write_bitstream" Command in Vivado 
 Post-Implementation Debug Using ECO Flow ECO フローを使用したインプリメンテーション後のデバッグ
 Post-Implementation Debug Using Incremental Compile Flow インクリメンタル コンパイル フローを使用したインプリメンテーション後のデバッグ
 Indirectly Program an FPGA using Vivado Device Programmer Vivado デバイス プログラマを使用した FPGA の間接的なプログラム
 Using Vivado Serial IO Analyzer 
 Using In-system IBERT In-System IBERT
 Debug Over PCIe PCIe を介したデバッグ (2017 年冬頃リリース予定)
 Introduction to Debugging Custom Logic Designs on F1 F1 インスタンス上のカスタム ロジック デザインのデバッグ
 Adding Debug Cores into a Design デバッグ コアをデザインに追加
 Using IBERT to Bring Up, Debug, and Optimize High-Speed Serial I/O Channels IBERT を使用して高速シリアル I/O チャネルを設定、デバッグ、および最適化
 Using a Vivado Hardware Manager to Program an FPGA Device Vivado ハードウェア マネージャーを使用して FPGA デバイスをプログラム
 How Do I Save the Lab Edition Project Dashboard Setup? Lab Edition のダッシュボードの設定を保存する方法を教えてください。

日本語

Lab Edition (英語)日本語
 What is Vivado Lab Edition and How Do I Install It? Vivado Lab Edition の概要およびインストール方法を教えてください。
プログラム (英語) (表示数を減らす ...)日本語
 How can I debug my design that is running on a board that is connected to a remote system? リモート システムに接続されているボード上で実行されているデザインをデバッグする方法を教えてください。
 Which JTAG Cables are Supported by Vivado? Vivado でサポートされている JTAG ケーブルを教えてください。
 What is Vivado Hardware Server? Vivado ハードウェア サーバーについて教えてください。
 How Do I Connect to a Target that is Running at Frequencies Lower than 15 MHz? 周波数が 15 MHz 以下で動作しているターゲットに接続する方法を教えてください。
 How Do I Connect to a JTAG Chain Which Contains More Than 32 Devices? 32 個以上のデバイスを含む JTAG チェーンに接続する方法を教えてください。
 Can I Speed Up the Frequency of the JTAG Connection to the Target Device? ターゲット デバイスへの JTAG 接続の周波数を上げることはできますか。
 Can I Use an Ethernet Connection to Connect to a Remote Target? リモート ターゲットへの接続にイーサネット接続を使用できますか。
コンフィギュレーション メモリのプログラム (英語)日本語
 How Do I Generate Bitstreams for Use with Configuration Memory Devices? コンフィギュレーション メモリ デバイスで使用するビットストリームの生成方法を教えてください。
 How Do I Create a Configuration Memory File (.mcs)? コンフィギュレーション メモリ ファイル (.mcs) の作成方法を教えてください。
 How Do I Verify and/or Readback the Configuration Data (i.e.,.bit file) Downloaded into an FPGA? FPGA にダウンロードするコンフィギュレーション データ (BIT ファイルなど) を検証/リードバックする方法を教えてください。
デバッグ (英語) (表示数を減らす ...)日本語
 What Are the Different Types of Debug Cores Supported in Vivado? Vivado をサポートされるデバッグ コアを教えてください。
 How Can I Automate Debugging My Design In-System? システムでのデザインのデバッグを自動化する方法を教えてください。
 What Are the Debug Cores that Can be Inserted into the Design? デザインに挿入できるデバッグ コアを教えてください。
 How Can I Invoke the Setup Debug Wizard and What Does it Do? Setup Debug ウィザードの起動方法とその使用方法について教えてください。
 What Are the Dashboards and How Do I Use Them? ダッシュボードの概要と使用方法を教えてください。
 How Do I Save Dashboard Settings? ダッシュボードの設定を保存する方法を教えてください。
 How Can I Cross Trigger Between an ILA and the Zynq-7000 PS Processor? 
 What Are the Differences Between the Debug Instantiation and Insertion Flow? デバッグのインスタンシエーション フローと挿入フローの違いを教えてください。
 What Does Xilinx Recommend For Choosing Nets for Debug? デバッグで使用するネットの選択における推奨事項を教えてください。
 What is MARK_DEBUG and Why Do I Need It? MARK_DEBUG 属性の概要およびこの属性が必要になる理由を教えてください。
 What Are Some of the Timing Considerations While Using an ILA Core? ILA コアを使用する際のタイミング考慮事項について教えてください。
 How Do You Save the ILA Data That has been Captured in a Waveform Window? 波形ウィンドウでキャプチャされた ILA データを保存する方法を教えてください。
シリアル IO (英語)日本語
 How Can I Generate a Custom IBERT Design for the GTs on My Board? ボード上の GT にカスタム IBERT デザインを生成する方法について教えてください。
 How Can I Automate Taking the Measurement of the Quality of My High-Speed Serial I/O Channel? 高速シリアル I/O チャネルの品質の計測を自動化する方法を教えてください。

重要なラーニング資料

ビデオ (英語) (表示数を減らす ...)デザイン ファイル日本語
 Post-Implementation Debug Using ECO Flow  ECO フローを使用したインプリメンテーション後のデバッグ
 In-system IBERT  In-System IBERT
 Using JTAG to AXI Master in Vivado  
 Debugging Remotely Using Vivado  Vivado を使用したリモート デバッグ
 Using New Dashboards in Vivado Logic Analyzer  Vivado ロジック解析での新しいダッシュボードの使用方法
 Debugging at Device Startup  デバイス スタートアップ時のデバッグ
 Using Advanced Encryption Standard Keys with the Battery-Backed (BBR) RAM  2018 年春頃リリース予定です。
 Setting and Editing Device Properties  デバイス プロパティの設定と編集
 Vivado Hardware Manager for UltraScale Memory IP  UltraScale メモリ IP のための Vivado ハードウェア マネージャーの使用
手法ガイド (英語)デザイン ファイル日本語
 Best practices for setting up logic analyzer core  ロジック アナライザー コアの最適な設定方法
ユーザー ガイド (英語)デザイン ファイル日本語
 Configuration and Debug Tips and Recommendations  コンフィギュレーション、デバッグに関するヒントおよび推奨事項
 Vivado Design Suite User Guide: Programming and Debugging  Vivado Design Suite ユーザー ガイド: プログラムおよびデバッグ
 UltraScale Architecture Configuration User Guide  UltraScale アーキテクチャ コンフィギュレーション ユーザー ガイド
 7 Series FPGAs Configuration User Guide  7 シリーズ FPGA コンフィギュレーション ユーザー ガイド
アプリケーション ノート (英語)デザイン ファイル日本語
 Bitstream Identification with USER_ACCESS using the Vivado Design Suite  Vivado Design Suite を使用した USER_ACCESS によるビットストリーム識別
 Automatic Insertion of Debug Logic for Transceivers in Synthesis DCPデザイン ファイル 
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