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Zynq-7000 デザイン ハブ - デザインの概要

日本語版の列に示されている資料によっては、英語版の更新に対応していないものがあります。日本語版は参考用としてご使用の上、最新の情報につきましては、必ず最新英語版をご参照ください。このページに示されている英語版はすべて最新版です。

別のデザイン ハブ ページには右側ペインからアクセスできます。

エンベデッド プロセッサ デザイン

製品ページには Zynq-7000 プラットフォームの製品情報が、Wiki ページZynq 101 ページ、および Zynq ブックには、その他の情報およびリソースが含まれています。

概要 (英語)日本語
 UltraFast Embedded Design Methodology Guide UltraFast エンベデッド デザイン設計手法ガイド
 Zynq-7000 AP SoC Software Developers Guide Zynq-7000 All Programmable SoC ソフトウェア開発者向けガイド
 Zynq-7000 AP SoC Technical Reference Manual Zynq-7000 All Programmable SoC テクニカル リファレンス マニュアル
 Zynq-7000 AP SoC: Embedded Design Tutorial Zynq-7000 AP SoC: エンベデッド デザイン チュートリアル
 Introducing the UltraFAST Embedded Design Methodology Checklist UltraFast エンベデッド デザイン設計手法チェックリストの説明
 Getting Started with Zynq-7000 AP SoC Wiki ページ (英語のみ) 
開発ツール (英語)日本語
 Zynq Development Tools Overview 
 Using, Building, and Running QEMU 
 Software Development Kit (SDK) Design Hub ソフトウェア開発キット (SDK) デザイン ハブ
 PetaLinux Tools Design Hub PetaLinux ツール デザイン ハブ
Vivado Design Suite (英語)日本語
 UltraFast Design Methodology Guide for the Vivado Design Suite UltraFast 設計手法ガイド (Vivado Design Suite 用)
 Vivado Design Suite User Guide: Embedded Processor Hardware Design Vivado Design Suite ユーザー ガイド: エンベデッド プロセッサ ハードウェア デザイン
 Vivado Design Suite Tutorial: Embedded Processor Hardware Design 
 Vivado Design Flows Overview Design Hub Vivado デザイン ハブ: デザイン フローの概要
Vivado Design Suite (英語)日本語
 Zynq-7000 AP SoC: Concepts, Tools, and Techniques Guide (ISE Design Suite) Zynq-7000 AP SoC: コンセプト、ツール、テクニック ガイド (ISE Design Suite)

デザイン リソース

ハードウェア開発プラットフォーム (英語のみ)デザイン ファイル日本語
 ZC702 評価キット デザイン ハブ  
 ZC706 評価キット デザイン ハブ  
アプリケーション リソース (英語)デザイン ファイル日本語
 Data Movers Design Hub  データ ムーバー デザイン ハブ
 Power Management Design Hub  消費電力管理デザイン ハブ
 Boot, Config, and Security Design Hub  ブート、コンフィギュレーション、およびセキュリティ デザイン ハブ
 Performance & Acceleration Design Hub  パフォーマンスおよびアクセラレーション デザイン ハブ
アプリケーション ノート (英語) (表示数を減らす ...)デザイン ファイル日本語
 Measured Boot of Zynq-7000 All Programmable SoCsデザイン ファイル 
 Scaling LiveVideo with the Video Processing Subsystemデザイン ファイル Video Processing Subsystem によるライブ ビデオのスケーリング
 eFUSE Programming on a Device Programmerデザイン ファイル デバイス プログラマを使用した eFUSE のプログラム
 Using Quality of Service (QoS) Capabilities in Zynq-7000 AP SoC Devicesデザイン ファイル 
 Real Time Video Engine 3.1 Implementation in Zynq-7000 AP SoCs  
 Using VxWorks 7 BSP with the Zynq-7000 AP SoC  
 Isolation Design Flow Lab for Zynq-7000 AP SoCs (Vivado Tools)デザイン ファイル 
 Xilinx Virtual Cable Running on Zynq-7000 Using the PetaLinux Toolsデザイン ファイル 
 Simulating High Performance Video Systems with Bus Functional Modelsデザイン ファイル バス ファンクション モデルを使用した高性能ビデオ システムのシミュレーション
 Implementing SMPTE SDI Interfaces with 7 Series GTX Transceiversデザイン ファイル 7 シリーズ GTX トランシーバーを使用した SMPTE SDI インターフェイスの実装
 JPEG 2000 and SMPTE 2022 Video over IP Reference  JPEG 2000 および SMPTE 2022 Video over IP リファレンス デザイン
 1G to 10G Ethernet Dynamic Switching Using Xilinx High Speed Serial IO Solutionデザイン ファイル ザイリンクスの高速シリアル IO ソリューションによる 1G と 10G Ethernet の動的切り替え
 Partial Reconfiguration of a Hardware Accelerator with Vivado Design Suiteデザイン ファイル Zynq-7000 AP SoC プロセッサにおける Vivado Design Suite を使用したハードウェア アクセラレータのパーシャル リコンフィギュレーション
 Protecting Sensitive Information in Zynq-7000 AP SoCデザイン ファイル Zynq-7000 AP SoC における機密情報の保護
 Run Time Integrity and Authentication Check of Zynq-7000 AP SoC System Memoryデザイン ファイル Zynq-7000 AP SoC システム メモリのラン タイム インテグリティと認証チェック
 Updating a System Securely in the Zynq-7000 AP SoCデザイン ファイル Zynq-7000 AP SoC システムのセキュア アップデート
 Changing the Cryptographic Key in Zynq-7000 AP SoCデザイン ファイル Zynq-7000 AP SoC における暗号化キーの変更
 Isolation Design Flow for Xilinx 7 Series FPGAs or Zynq-7000 AP SoCsデザイン ファイル 
 Using ENEA OSE BSP for the Zynq-7000 AP SoCデザイン ファイル All Programmable SoC のシステム性能解析
 System Performance Analysis of an All Programmable SoCデザイン ファイル All Programmable SoC のシステム性能解析
 AXI Chip2Chip Reference Design for Real-Time Video Applicationsデザイン ファイル リアルタイム ビデオ アプリケーション向け AXI Chip2Chip Aurora リファレンス デザイン
 Boost Software Performance on Zynq-7000 AP SoC with NEONデザイン ファイル NEON を使用して Zynq-7000 AP SoC でのソフトウェア性能を向上
 Designing High-Performance Video Systems with the Zynq-7000 AP SoC Using IP Integratorデザイン ファイル Zynq-7000 All Programmable SoC による高性能ビデオ システムの IP インテグレーターを用いた設計
 Implementation of Signal Processing IP on Zynq-7000 AP SoC to Post-Process XADC Samplesデザイン ファイル Zynq-7000 AP SoC に信号処理 IP を実装して XADC サンプルを後処理
 Zynq-7000 Platform Software Development Using the ARM DS-5 Toolchainデザイン ファイル ARM DS-5 ツールチェーンを使用した Zynq-7000 プラットフォーム ソフトウェアの開発
 PIPE Mode Simulation Using Integrated Endpoint PCI Express Block in Gen2 x8 Configurationデザイン ファイル
デザイン ファイル
 Gen2 x8 コンフィギュレーションの Integrated PCI Express Endpoint Block を使用する PIPE モード シミュレーション
 Implementing Analog Data Acquisition using the Zynq-7000 AP SoC Processing System with the XADC AXI Interfaceデザイン ファイル Zynq-7000 AP SoC プロセッシング システムと XADC AXI インターフェイスを使用したアナログ データの取得
 System Monitoring using the Zynq-7000 Processing System with a Xilinx Analog-to-Digital Converter AXI Interfaceデザイン ファイル Zynq-7000 AP SoC プロセッシング システムと XADC AXI インターフェイスを使用するシステム モニタリング
 Secure Boot of Zynq-7000 AP SoCデザイン ファイル Zynq-7000 All Programmqable SoC のセキュア ブート
 Using the Zynq-7000 Processing System (PS) to Xilinx Analog to Digital Converter (XADC) Dedicated Interfaceデザイン ファイル Zynq-7000 のプロセッシング システム (PS) と XADC (ザイリンクス アナログ-デジタル コンバーター) を結ぶ専用インターフェイスを利用したシステム監視および外部チャネル計測のインプリメント
 PCI Express Endpoint-DMA Initiator Subsystem Application Noteデザイン ファイル 
 Zynq-7000 AP SoC Accelerator for Floating-Point Matrix Multiplication using Vivado High-Level Synthesis (HLS)デザイン ファイル Vivado HLS で設計する浮動小数点行列乗算の Zynq アクセラレータ
 Xilinx Accelerating OpenCV Applications with Zynq using Vivado High-Level Synthesis (HLS) Video Librariesデザイン ファイル Vivado HLS ビデオ ライブラリを使用して Zynq-7000 All Programmable SoC で OpenCV アプリケーションを高速化
 AXI Chip2Chip Reference Design for Real-Time Video Applicationデザイン ファイル リアルタイム ビデオ アプリケーション向け AXI Chip2Chip リファレンス デザイン
 Partial Reconfiguration of a Hardware Accelerator on Zynq-7000 AP SoC Devicesデザイン ファイル 
 Using VxWorks BSP with Zynq-7000 AP SoC  
 Real Time Video Engine 2.1 Implementation in Xilinx Zynq-7000 AP SoCs  Zynq-7000 All Programmable SoC での RTVE (Real Time Video Engine) 2.1 のインプリメンテーション
 Simple AMP: Zynq SoC Cortex-A9 Bare-Metal System with MicroBlaze Processorデザイン ファイル シンプルな AMP: Zynq SoC Cortex-A9 ベアメタル システムと MicroBlaze プロセッサ
 Implementing SMPTE SDI Interfaces with Zynq-7000 AP SoC GTX Transceiversデザイン ファイル Zynq-7000 AP SoC GTX トランシーバーを使用した SMPTE SDI インターフェイスの実装
 Isolation Design Flow for Xilinx 7 Series FPGAs or Zynq-7000 AP SoCs (ISE Tools)デザイン ファイル アイソレーション デザイン フローを使用して 7 シリーズ FPGA/Zynq-7000 AP SoC で安全かつ信頼性に優れたシングル デバイス デザインを開発
 PS and PL Ethernet Performance and Jumbo Frame Support with PL Ethernet in the Zynq-7000 AP SoCデザイン ファイル 
 Simple AMP: Bare-Metal System Running on Both Cortex-A9 Processorsデザイン ファイル シンプルな AMP: 2 つの Cortex-A9 プロセッサの両方で動作するベアメタル システム
 Simple AMP Running Linux and Bare-Metal System on Both Zynq SoC Processorsデザイン ファイル シンプルな AMP: 2 つの Zynq SoC プロセッサ上で動作する Linux およびベアメタル システム
 LightWeight IP (lwIP) Application Examples v4.0デザイン ファイル 
 AXI USB 2.0 Device: Demonstrating the Performance for Bulk and Isochronous Transfersデザイン ファイル AXI USB 2.0 デバイス: バルク転送およびアイソクロナス転送におけるパフォーマンスの検証
 Zynq-7000 AP SoC Sobel Filter Implementation Using the Vivado High-Level Synthesis (HLS) Toolデザイン ファイル Zynq All Programmable SoC での Vivado HLS ツールを使用した Sobel フィルターのインプリメント
 1080p60 Camera Image Processing Reference Designデザイン ファイル 
 Designing High-Performance Video Systems with the Zynq-7000 AP SoCデザイン ファイル Zynq-7000 All Programmable SoC を使用した高性能ビデオシステムの設計
 Processor Control of Vivado High-Level Synthesis (HLS) Designs  
 Hardware In The Loop (HIL) Simulation for the Zynq-7000 AP SoCデザイン ファイル 
 AXI VDMA Reference Designデザイン ファイル AXI VDMA リファレンス デザイン
 All Digital VCXO Replacement for Gigabit Transceiver Applications (7 Series/Zynq-7000)  
 Parameterizable CORDIC-Based Floating-Point Library Operationsデザイン ファイル パラメーター変更可能な CORDIC ベースの浮動小数点ライブラリ演算
ホワイト ペーパー (英語) (表示数を減らす ...)デザイン ファイル日本語
 Using the MicroBlaze Processor to Accelerate Cost-Sensitive Embedded System Development  MicroBlaze プロセッサ コアの使用でコスト重視のエンベデッド システム開発を迅速化
 Leveraging Asymmetric Authentication to Enhance Security-Critical Applications Using Zynq-7000 AP SoCs  
 A FIPS 140-2 Primer for the Zynq-7000 AP SoC  
 Meeting Embedded HMI Requirements Using Zynq-7000 High-Performance AP SoCs  
 Xilinx Reduces Risk and Increases Efficiency for IEC61508  
 Reducing System BOM Cost with Xilinxapos;s Low-End Portfolio  
 Leveraging Data-Mover IPs for Data Movement in Zynq-7000 AP SoC Systems  
 High Performance Machine Vision Systems using Xilinx 7 Series Technology  ザイリンクスの 7 シリーズ テクノロジを使用する高性能マシン ビジョン システム
 Adaptive Beamforming for Radar: Floating-Point QRD+WBS in an FPGA  
 Enabling High-Speed Radio Designs with Xilinx All Programmable FPGAs and SoCs  
 Efficient Implementation of Analog Signal Processing Functions in Xilinx All Programmable Devices  
 Understanding and Mitigating System-Level ESD and EOS Events in Xilinx 7 Series Devices  
 TrustZone Technology Support in Zynq-7000 AP SoC  
 Secure Boot in the Zynq-7000 AP SoC  
 The Xilinx Isolation Design Flow for Fault-Tolerant Systems  
 Flexible Waveform Processing with the Xilinx Zynq-7000 Extensible Processing Platform  
 Addressing the Graphics Revolution for Automotive Instrumentation Design Using FPGAs  FPGA を使用する車載インパネ デザインで激変するグラフィックスに対応
 Achieving High Performance DDR3 Data Rates  Virtex-7 および Kintex-7 FPGA で高性能 DDR3 データレー トを実現
 Xilinx Devices in Portable Ultrasound Systems  
 Reducing Switching Power with Intelligent Clock Gating  高度なクロック ゲーティングによるスイッチング電力の削減
 EPPs: The Ideal Solution for a Wide Range of Embedded Systems  EPP: エンべデッド システムに幅広く対応した理想的なソリューション
 Xilinx Next Generation 28 nm FPGA Technology Overview  28 nm テクノロジを採用したザイリンクスの次世代 FPGA
サンプル デザインデザイン ファイル日本語
 Zynq-7000 AP SoC - Example Designs and Tech Tips  Zynq-7000 AP SoC - サンプル デザインおよびテクニカル ヒント

シリコン資料

Zynq-7000 データシート (英語)日本語
 Zynq-7000 AP SoC Overview Zynq-7000 All Programmable SoC 概要
 Zynq-7000 AP SoC Overview for Automotive Devices XA Zynq-7000 All Programmable SoC 概要
 Zynq-7000Q AP SoC Overview for Defense-Grade Devices 防衛グレード Zynq-7000Q All Programmable SoC 概要
 Zynq-7000 AP SoC Product Selection Guide 
 Zynq-7000 AP SoC (Z-7007S, Z-7012S, Z-7014S, Z-7010, Z-7015, and Z-7020): DC and AC Switching Characteristics Data Sheet Zynq-7000 All Programmable SoC (Z-7007S、Z-7012S、Z-7014S、Z-7010、Z-7015、Z-7020): DC 特性および AC スイッチ特性データシート
 Zynq-7000 AP SoC (Z-7030, Z-7045, and Z-7100): DC and AC Switching Characteristics Data Sheet Zynq-7000 All Programmable SoC (Z-7030、Z-7035、Z-7045、Z-7100): DC 特性および AC スイッチ特性データシート
 Zynq-7000 AP SoC Bus Functional Model v2.0 Data Sheet 
 Zynq-7000 AP SoC and 7 Series Devices Memory Interface Solutions v4.2 Data Sheet Zynq-7000 AP SoC および 7 シリーズ デバイス メモリ インターフェイス ソリューション (v4.1)
Zynq-7000 ユーザー ガイド (英語)日本語
 Zynq-7000 AP SoC PCB Design and Pin Planning Guide Zynq-7000 All Programmable SoC PCB デザイン ガイド
 Zynq-7000 AP SoC Packaging and Pinout Specification Zynq-7000 All Programmable SoC パッケージおよびピン配置: 製品仕様
 Programming ARM TrustZone Architecture on the Xilinx Zynq-7000 AP SoC User Guide ザイリンクス Zynq-7000 All Programmable SoC での ARM TrustZone アーキテクチャのプログラミング ユーザー ガイド
 7 Series FPGAs and Zynq-7000 AP SoC XADC Dual 12-Bit 1 MSPS Analog-to-Digital Converter User Guide 7 シリーズ FPGA および Zynq-7000 All Programmable SoC XADC デュアル 12 ビット 1MSPS アナログ-デジタル コンバーター ユーザー ガイド
 Zynq-7000 AP SoC Architecture Porting Guide Zynq-7000 All Programmable SoC アーキテクチャ ポーティング ガイド
7 シリーズ ユーザー ガイド (英語)日本語
 7 Series FPGAs GTP Transceivers User Guide 7 シリーズ FPGA GTP トランシーバー ユーザー ガイド
 7 Series FPGAs GTX/GTH Transceivers User Guide 7 シリーズ FPGA GTX/GTH トランシーバー ユーザー ガイド
 7 Series FPGAs DSP48E1 Slice User Guide 7 シリーズ FPGA DSP48E1 スライス ユーザー ガイド
 7 Series FPGAs Configurable Logic Block User Guide 7 シリーズ FPGA コンフィギャラブル ロジック ブロック ユーザー ガイド
 7 Series FPGAs Memory Resources User Guide 7 シリーズ FPGA メモリ リソース ユーザー ガイド
 7 Series FPGAs Clocking Resources User Guide 7 シリーズ FPGA クロッキング リソース ユーザー ガイド
 7 Series FPGAs SelectIO Resources User Guide 7 シリーズ FPGA SelectIO リソース ユーザー ガイド