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製品の特長

次世代のイーサネット展開をサポートするため、ザイリンクスは、16nm FinFET を採用した Virtex® UltraScale+™ FPGAファミリに 58Gb/s トランシーバーを統合しました。

Virtex UltraScale+ 58G PAM4 FPGA は、既存インフラの帯域幅を 2 倍にし、ASIC の寿命を延長します。ハードウェア プログラマブルなデバイスに最速トランシーバーを搭載したこの FPGA は、最新の光技術だけでなく、将来的な要件にも対応するシステムを構築できます。


主な機能と利点

 

最速トランシーバー

テラビット級システムに対応する最大 58Gb/s で動作する 48 個の PAM4 トランシーバーと 25G のインターオペラビリティ向けに 32.75Gb/s で動作する 32 個のトランシーバー

柔軟なコネクティビティ

バックプレーンは 28G/58G、チップ間接続およびチップと光ファイバーの接続は 32.75G/58G

優れたシグナル インテグリティ

強化された連続適応型 RX イコライゼーションと内蔵の KR-FEC による、50/100/200/400G 光通信/プロトコル向けの高品質な高速信号

強化された DSP コア

データセンターの多様なアプリケーションに対応する最大 38TOPs (22 TeraMACs) の DSP 演算性能

フットプリント削減

イーサネット、ギアボックス、メモリ、および PCIe 用のディスクリート回路が不要になるため、性能はそのままで小型フットプリントでのシステム設計が可能

PCI Express 用統合ブロック

100G アプリケーションの Gen3 x16 Integrated PCIe® ブロック


詳細はこちら

製品仕様、または問い合わせ先の表示はこちらをクリックします。

アプリケーション

Virtex UltraScale+ 58G PAM4 FPGA がもたらす新たな可能性を探る

 

トランスポート/メトロ ネットワーク

トランスポート/メトロ ネットワーク

光ファイバーやデータセンターがエンドユーザーとの距離を縮める一方で、メトロ ネットワークは複数の光通信/プロトコルに対応し、低レイテンシ接続、数 Tb/s までの拡張が求められます。Virtex UltraScale+ 58G PAM4 FPGA は、PAM4 トランシーバーを搭載しているため、これらの要件に応えることが可能な上、優れた柔軟性と適応性を持つソリューションを提供します。


データセンター インターコネクト

Virtex UltraScale+ 58G PAM4 FPGA は、ルーター、サーバー、およびマルチテナント データセンター間における数百 Gb/s の接続要件に応えるため、優れたポート密度やワットあたり性能により小型フットプリントで最新の光通信/プロトコルをサポートし、高い I/O スループットを実現します。

データセンター インターコネクト

スマート NIC (Network Interface Card)

スマート NIC (Network Interface Card)

Virtex UltraScale+ 58G PAM4 FPGA に統合された PAM4 トランシーバーを使用することで、ギアボックスが不要になり、小型の PCIe フォーム ファクターでシンプルな設計が可能になります。また、FPGA は多様なワークロードに対応するため、Virtex UltraScale+ 58G PAM4 FPGA を搭載したこの新しい SmartNIC は、コネクティビティを犠牲にすることなく機能を動的にシフトして、計算、ネットワーク、ストレージにおいてワークロードを追加したり、組み合わせることが可能になります。


ネットワーク テスト装置

スペクトラム/ネットワーク アナライザーなどの信号解析装置には、より高度な信号処理能力と広い I/O 帯域幅が必要です。Virtex UltraScale+ 58G PAM4 FPGA は、データ格納用の UltraRAM と、係数テーブル/ FIFO 用のブロック RAM を提供します。また、多数の DSP ブロックと 80 個の高速トランシーバーを搭載しているため、テスト/計測機器プラットフォームの設計者は、柔軟性と拡張性がある高性能システムを構築できます。

ネットワーク テスト装置
製品一覧
  XCVU27P XCVU29P
システム ロジック セル (K) 2,835 3,780
DSP スライス 9,216 12,288
メモリ (Mb) 341 455
GTY/GTM トランシーバー (32.75/58Gb/s) 32/48 32/48
I/O 676 676
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資料

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トレーニング コース

ザイリンクスの FPGA およびエンベデッド SoC デザイン トレーニングでは、今すぐ設計を開始するために必要な知識が身につくハンズオン コースを提供しています。


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最も優れた動的処理技術を提供するインテリジェント コンピューティング機能で迅速なイノベーションが可能になります。


ツールおよびユーティリティ

ザイリンクスは、デザインの生産性を最大限に発揮させるための包括的なツールとユーティリティを提供しています。


開発ボードとキット

ザイリンクスの評価ボードとキットを活用することで開発を簡単に開始できます。


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デザイン アドバイザリで知識を身に付けたり、既知の問題から解決法を見つけたりできます。さまざまなサポート リソースを提供しています。

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