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AR# 18622

6.1i CORE Generator IP アップデート #1 (G_ip1) - System Logic IP の既知の問題

説明

キーワード : CORE, Generator, COREGen, IP, update, lfsr, linear, feedback, shift, register, bit, MUX, BaseBlox, アップデート, リニア, 線形, フィードバック, シフト, レジスタ, ビット, マルチプレクサ

重要度 : 標準

概要 :
このアンサーでは、6.1i IP アップデート #1 (G_ip1) でリリースされた System Logic IP の既知の問題を示します。

ソリューション

LogiCORE Asynchronous FIFO v5.1 : FIFO のワード数が 15 以外の場合、非同期 FIFO を生成できません。 また、type=Dist メモリの非同期 FIFO を生成すると、CORE Generator が停止してしまい、タスク バーから CORE Generator を終了させる必要があります。
詳細は、(Xilinx Answer 18708) を参照してください。

LogiCORE Linear Feedback Shift Register v2.0 : "ERROR: 「ERROR: Unable to customize core Linear Feedback Shift Register.」というエラー メッセージが表示されます。 6.1i IP アップデート #1 をインストールし、コア カタログから LFSR v2.0 を追加すると、LFSR v2.0 の GUI を開くことができません。
詳細は、(Xilinx Answer 18620) を参照してください。

LogiCORE Bit MUX v7.0 : 「ERROR:Pack:1141 wide function starting with F6 MUX」という MAP のエラー メッセージが表示されます。 CORE Generator で生成した RPM を含む Bit MUX v7.0 がデザインに含まれる場合、MAP でエラーが発生する場合があります。 この問題は、Virtex-II、Virtex-II Pro、Spartan-3 で発生します。
詳細は、(Xilinx Answer 18621) を参照してください。
AR# 18622
日付 07/28/2010
ステータス アーカイブ
種類 一般
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