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AR# 19001

ISE 6.2i インストール - サービス パック 3 のリリース ノート/README

説明

キーワード : SP1, SP2, SP3, Solaris, UNIX, PC, Linux, software, update, ソフトウェア, アップデート

重要度 : 標準

概要 :
このアンサーでは、6.2i サービス パック 3 のリリース ノートの内容を示します。 リリース ノートには、インストールの手順および今回までの 6.2i サービス パックで修正された問題のリストなどが含まれます。

ソリューション

1

ISE 6.2i サービス パック 3 をインストールすると、ソフトウェアのバージョンが 6.2.03i にアップデートされます。

メモ :
1. セットアップ時に指定するディレクトリには、ISE 6.2i インストール ファイルが含まれている必要があります。 アップデートされるのは、既存ファイルのみです。 以前にインストールしていなかったデバイスを追加する場合、サービス パック 3 をインストールする前に ISE 6.2i の CD から、そのデバイスをインストールする必要があります。
2. ザイリンクス ISE 6.2i 環境変数を必ず設定してから、サービス パック 3 をインストールしてください。

PC の場合

次のいずれかの手順に従います。

方法 1 :
1. 次のサイトから 6_2_03i_pc.exe をダウンロードします。
http://www.xilinx.co.jp/xlnx/xil_sw_updates_home.jsp
2. 6_2_03i_pc.exe を実行します。

方法 2 :
1. Internet Explorer を使用してインターネットに接続します。
2. 次のいずれかの方法で、WebUpdate プログラムを起動します。
- [スタート] -> [プログラム] -> [Xilinx ISE 6] -> [アクセサリ] -> [Webupdate] をクリックします。
- Project Navigator で [Help] -> [Software Updates] をクリックします。

Solaris の場合
1. 次のサイトから 6_2_03i_sol.tar.gz をダウンロードします。
http://www.xilinx.co.jp/xlnx/xil_sw_updates_home.jsp
2. ダウンロードしたファイルを空のディレクトリ内で解凍します。

例 :
cd /home/staging_dir
gzip -d 6_2_03i_sol.tar.gz
tar xvf 6_2_03i_sol.tar

3. 6_2_03i_sol/setup を実行します。

Linux の場合
1. 次のサイトから 6_2_03i_lin.tar.gz をダウンロードします。
http://www.xilinx.co.jp/xlnx/xil_sw_updates_home.jsp
2. ダウンロードしたファイルを空のディレクトリ内で解凍します。

例 :
cd /home/staging_dir
gzip -d 6_2_03i_lin.tar.gz
tar xvf 6_2_03i_lin.tar

3. 6_2_03i_lin/setup を実行します。

2

6.2i サービス パックで修正された問題

Architecture Wizard

(SP2) 6.1i Architecture Wizard、DCM - 「ERROR: Only Low Frequency mode is valid for Cascading in Series. Please enter an Input Clock Frequency value within the valid Low Frequency Range...」というエラー メッセージが表示される (Xilinx Answer 19301)
(SP2) 6.1i Architecture Wizard、DCM - Virtex-II Pro デバイスで 2X フィードバックが使用できない 理由について (Xilinx Answer 19302)

BitGen

(SP2) 6.1i BitGen - XAPP751 に記述されているとおり Spartan-3 LVDS/RSDS 標準を使用する場合、仕様を満たすために BitGen の設定を変更する必要がある (Xilinx Answer 19204)
(SP2) 6.1i BitGen - Virtex-II Pro X の場合、GT10 の PMA_SPEED 属性を正しく設定するために、BitGen をアップデートする必要がある (Xilinx Answer 19205)
(SP2) 6.1i iMPACT/BitGen - qvirtex2 および qrvirtex2 ビットストリームを生成したり、iMPACT で割り当てると、「WARNING:Bitstream:100 - Could not determine proper JTAG IDCODE from family name」という警告メッセージが表示される (Xilinx Answer 19202)
(SP2) 6.1i SP3 BitGen - -intstyle オプションを使用するとエラー/警告メッセージが表示されず、問題があるかどうかわからない (Xilinx Answer 18844)
(SP1) 6.1i SP3 - 「ERROR:BitGen:145 - Pin R5 is a persistent pin, but a component exists in its IOB. Please rerun PAR with the persistent pins prohibited from use.」というエラー メッセージが表示される (Xilinx Answer 18837)

CompXLib

(SP1) 6.2i CompXLib - 「ERROR:cxl[env]:15- invalid MODELSIM env value detected」というエラー メッセージが表示される (Xilinx Answer 18233)

CPLD

(SP3) 6.2i CPLD CoolRunner-II - MLF パッケージ (QF32/QF48) にデバイス XC2C32/XC2C64 のサポートを追加 (Xilinx Answer 18907)
(SP3) 6.2i PACE CoolRunner-II - XC2C32 PC44 でピン 24 が表示されない (Xilinx Answer 19430)
(SP3) 6.2i TSIM CoolRunner XPLA3 - タイミング シミュレーションで入力レジスタの値が変化しない (Xilinx Answer 19431)
(SP2) 6.1i CPLDFit - HTML レポートのリンク機能が Windows OS の英語版でしか使用できない (Xilinx Answer 18772)
(SP2) 6.2i CPLD CoolRunner-II Project Navigator - スピード テンプレートで高速入力レジスタがデフォルトで無効になっている (Xilinx Answer 19183)
(SP1) 6.2i CPLD CoolRunner-II - MLF パッケージ (QF32/QF48) にデバイス XC2C32/XC2C64 のサポートを追加 (Xilinx Answer 18907)
(SP1) 6.2i CPLDFit - 「ERROR:Cpld:1106 - Signal 'SCLK' attached to BUFG drives both an active-high and active-low CLOCK」というエラー メッセージが表示される (Xilinx Answer 18993)
(SP1) 6.2i CPLD - TSim : 「Vsim - instance does not have generic named 'tperiod_clk_posedge', failed to find matching specify timing constraint」というエラー メッセージが表示される (Xilinx Answer 18797)
(SP1) 6.1i CPLD BSDLAnno - CoolRunner-II の BSDL ファイルで信号名がアノテートされない (Xilinx Answer 18805)
(SP1) BSDL、CoolRunner-II - XC2C384 FT256 の BSDL ファイルで EXTEST、INTEST などの JTAG 操作が正常に実行されない (Xilinx Answer 18921)

Data2MEM

(SP3) 6.1i Data2MEM - 「boot」をパスに使用すると Data2MEM で適切に処理されない (Xilinx Answer 18841)
Floorplanner

(SP2) 6.2i Floorplanner - UCF に制約を書き込んでいると、「FATAL ERROR Gui Utilities: Win App ....」 という致命的なエラー メッセージが表示されてツールがクラッシュする (Xilinx Answer 18994)

FPGA Editor

(SP2) 6.2i FPGA Editor - プローブ エラー 178 「Could not route probe...」および警告 561 「Can't find compatible IO standard...」というメッセージが表示される (Xilinx Answer 19141)

IBISWriter

(SP2) 6.2i SP2 IBISWriter - Spartan-3 の DCI 入力モデルで予期しない結果が示される (Xilinx Answer 19238)

IMPACT

(SP3) 6.2i IMPACT - CDF ファイルをロードすると、「BYTE SWAP not enabled」 というメッセージが表示される (Xilinx Answer 19163)
(SP3) 6.1i SP2 iMPACT - playxsvf v4.11 を使用して XSVF ファイルを生成すると「ERROR: Unsupported XSVF command」というエラー メッセージが表示される (Xilinx Answer 18565)
(SP3) 6.2i iMPACT - [Automatic Checksum Insertion] を有効にして xc1800 PROM をプログラムすると、「ERROR:iMPACT:583」 のようなエラー メッセージが表示される (Xilinx Answer 19435)
(SP3) 6.2i iMPACT - プラットフォーム フラッシュ PROM XCF00P の [Parallel Mode] オプションが機能しない (Xilinx Answer 19390)
(SP2) 6.1i iMPACT/PROMGen - 2 つの PROM を使用する 1 つのリビジョンに複数の MCS ファイルを追加すると iMPACT で「ERROR:1836/1840」というエラー メッセージが表示される (Xilinx Answer 18923)
(SP2) 6.1i iMPACT - XCCACE の直前にあるデバイスに対して JTAG 操作を実行できない (Xilinx Answer 19090)
(SP2) 6.1i SP3 iMPACT - 圧縮 MCS ファイルを使用しても表示される PROM 使用率が低くならない、または圧縮 PROM ファイルの生成時に「ERROR:Bitstream:25 ...」というエラー メッセージが表示される (Xilinx Answer 19206)
(SP2) 6.2i iMPACT - サードパーティ BSDL ファイルを含む JTAG チェーンを初期化すると「ERROR:IMPACT - syntax error at line xxx」というエラー メッセージが表示される (Xilinx Answer 19060)
(SP2) 6.2i iMPACT - メモリ エレメントを含むデザインでの iMPACT リードバック検証が改善されたことで、FPGA 検証中に DONE ピンが Low になる (Xilinx Answer 19207)
(SP2) 6.1i iMPACT - XC1800 PROM のユーザーコードをプログラムすると、「ERROR:iMPACT:583 - '1': The idcode read from the device does not match the idcode in the bsdl File」 というエラーメッセージが表示される (Xilinx Answer 19208)
(SP2) 6.2i iMPACT - 圧縮した 32MB プラットフォーム フラッシュ PROM (XCF32P) に対して SVF ファイルを生成するときに時間がかかる (Xilinx Answer 18724)
(SP1) 6.1i iMPACT - BSCAN ファイル生成モードで、自動チェックサム挿入をオンにして XCFP の PROM のコンカレント モードを切り替えるとツールがクラッシュする (Xilinx Answer 18729)
(SP1) iMPACT 6.1i SP2 - playxsvf v4.11 を使用して XSVF ファイルを生成すると「ERROR: Unsupported XSVF command」というエラー メッセージが表示される (Xilinx Answer 18565)
(SP1) 6.1i iMPACT - デザインに SRL16 または LUT RAM (分散 RAM) を使用していると、デザインが正しく動作していても検証でエラーが発生する (Xilinx Answer 18725)
(SP1) iMPACT 6.1i - 18V00 または Platform Flash XCF PROM を読み込み禁止に設定すると JTAG USERCODE が読み込まれない (Xilinx Answer 18726)
(SP1) 6.1i iMPACT - iMPACT で生成された System ACE CF ファイルを使用して Spartan-3 デバイスをプログラムできない (Xilinx Answer 18925)
(SP1) 6.1i iMPACT/PROMGen - 2 つの PROM を使用する 1 つのリビジョンに複数の MCS ファイルを追加すると iMPACT で「ERROR:1836/1840」というエラー メッセージが表示される (Xilinx Answer 18923)

インクリメンタル デザイン

(SP2) 6.2i SP2 インクリメンタル デザイン - スライスが 100% ガイドされている場合でも、MAP で AREA_GROUPS が再インプリメントされる (Xilinx Answer 18758)
(SP2) 6.2i SP2 インクリメンタル デザイン - FMAP または KEEP_HIERARCHY プロパティが設定されたエリア グループのロジック レベルが高くなっている可能性がある (Xilinx Answer 19203)

MAP

(SP2) 6.2i Virtex-II Pro MAP - バス上の個別のピンに対して tie-off 値の上書きがサポートされるよう修正済み (Xilinx Answer 19281)
(SP2) 6.1i Virtex-II MAP - 「FATAL_ERROR:Pack:pksvrbaseslice.c:249:1.16 - Problem building usage for comp ...」というエラー メッセージが表示される (Xilinx Answer 18447)
(SP2) 6.2i MAP - KEEP_HIERARCHY と指定配線が原因となってパックでエラーが発生する (Xilinx Answer 19282)
(SP2) 6.2i Virtex-II Pro MAP - -timing オプションを使用した場合、Phase 10.18 で MAP がエラーになる (Xilinx Answer 19288)
(SP2) 6.2i Virtex-II MAP - PROHIBIT 制約を使用するとタイミング ドリブン マップ (map -timing) が実行されない (Xilinx Answer 19299)
(SP1) 6.1i Virtex-II MAP - 「FATAL_ERROR:Pack:pksvrbaseslice.c:249:1.16 - Problem building usage for comp ...」というエラー メッセージが表示される (Xilinx Answer 18447)
(SP1) 6.1i Virtex-II MAP - 「ERROR:DesignRules:368 - Netcheck: Sourceless. Net xxx has no source.」というエラー メッセージが表示される (Xilinx Answer 19048)
(SP1) 6.1i Virtex-II MAP - タイミング ドリブン パック オプションを使用すると 「Error: Unable to swap OTCLK in IOB」というエラー メッセージが表示される (Xilinx Answer 18782)
(SP1) 6.1i Virtex-II MAP - タイミング ドリブン パックを実行中に MAP がクラッシュする (Xilinx Answer 19049)

NetGen

(SP3) 6.2i SP2 NetGen - 「Cannot correlate logic element '"U1/U1/SLAVEBUF.DIFFIN" (tag=7 in view "FRAGCOVERED")' is with this component 'in_n' cannot continue hierarchical correlation)」というエラー メッセージが表示される (Xilinx Answer 19426)

NGDBuild

(SP3) 6.1i SP2 NGDBuild - Linux および Solaris で「EXCEPTION:Xdm:xdm_stubread.c...」というエラー メッセージが表示される (Xilinx Answer 18514)

PACE

(SP3) 6.2i PACE - Virtex-II Pro FG676 パッケージに対して SSO 解析が実行できない (Xilinx Answer 19219)
(SP2) 6.2i PACE - 無効なドライブおよびスルー レートが設定できてしまう (Xilinx Answer 19248)
(SP2) 6.2i PACE - 重複する LOC 制約が UCF ファイルに記述される (Xilinx Answer 19249)
(SP2) 6.2 PACE - 回路図に OBUFTDS が含まれていると PACE が停止する (Xilinx Answer 18625)
(SP1) 6.2i PACE - CSV データを新規デザインに読み込むと不正な HDL 構文が記述される (Xilinx Answer 18984)
(SP1) 6.2i PACE - グループ ウィンドウからバスを配置すると、グループ ウィンドウにはピンが配置されたことが示されるが、[Design Object List] ウィンドウには個々のピンが配置されたことが示されない (Xilinx Answer 18985)

PAR

(SP3) 6.1i Virtex-II PAR - 配線で「FATAL_ERROR:Ncd:basncsignal.c:283:1.39.8.1 - Could not find a bel for a signal」というエラー メッセージが表示される (Xilinx Answer 19044)
(SP3) 6.2i PAR - 配線ツールの自動ホールド タイム調整で一部のエラーが修正されるが、新たなエラーが発生する (Xilinx Answer 19478)
(SP3) 6.2i Spartan-3 MAP - -timing オプションを使用して MAP を実行すると 「ERROR:Place:baspltctask.c:261:1.36.4.1 - Error : '3」 というエラー メッセージが表示される (Xilinx Answer 19213)
(SP3) 6.2i Spartan-3 PAR - Spartan-3 のパッド レポートの Vccint が不正である (Xilinx Answer 19479)
(SP3) 6.2i PAR - 追加エフォート (-xe) を使用してタイミング ドリブン マップを実行すると、PAR が実行されない (Xilinx Answer 18996)
(SP3) 6.2i Spartan-3 PAR - IOB ローカル クロックが正しく配線されない (Xilinx Answer 19313)
(SP3) 6.2i Virtex-II PAR - 配置ツールのチェックにより、有効な 512x36 BRAM および MULT のペアがエラーになる (Xilinx Answer 19370)
(SP2) 6.1i Virtex-II、Spartan-3 PAR - Virtex-II および Virtex-II Pro のローカル クロック配線が向上 (Xilinx Answer 19287)
(SP2) 6.2i Virtex-II PAR - DCM の自動配置で最適な結果が得られない (Xilinx Answer 19298)
(SP1) 6.1i Spartan-3 PAR - 制約の処理中に RPM の範囲制約が拒否される (Xilinx Answer 18682)
(SP1) 6.1i Virtex-II PAR - フェーズ 2.2 で配置がクラッシュする (Xilinx Answer 19050)
(SP1) 6.1i Spartan-3 PAR - キャリー チェーンの配置が最適でないと周波数が低くなる (Xilinx Answer 18781)
(SP1) 6.1i PAR - モジュール デザインの最終アセンブリ段階で、クロック配線にグローバル リソースが使用されない (Xilinx Answer 18073)
(SP1) 6.1i PAR - パッド レポートに示される駆動強度の値が間違っている (Xilinx Answer 18763)
(SP1) 6.1i Spartan-3 PAR - Spartan-3 の配置配線 (PAR) レポートに示されるスライス利用率の値が間違っている (Xilinx Answer 19004)

PrimeTime

(SP2) 6.2i PrimeTime - 特定の DCM (CLK90、CLK180、CLK270) を使用すると clock_latency が正しく計算されない (Xilinx Answer 19246)
(SP2) 6.2i PrimeTime - OFFSET IN パスの PrimeTime と TRCE が 1 クロック サイクル分ずれる (Xilinx Answer 19247)
(SP1) 6.1i PrimeTime/Create_SDC - 変換中にバス区切り文字の問題が発生する (Xilinx Answer 18980)
(SP1) 6.2i PrimeTime/Create_SDC - # のないコメントがあると PrimeTime で制約が読み込まれない (Xilinx Answer 18981)
(SP1) 6.2i PrimeTime - 「Error: Invalid waveform. Edges must be an even number.」というエラー メッセージが表示される (Xilinx Answer 18982)
(SP1) 6.2i PrimeTime/Create_SDC - OFFSET 制約の LOW キーワードが正しく処理されない (Xilinx Answer 18983) を参照してください。

Project Navigator

(SP3) 6.1i ISE - 拡張子が大文字の .UCF となっている制約ファイルが Project Navigator のインプリメンテーションで無視される (Xilinx Answer 18856)
(SP2) 6.1i ISE - Project Navigator で Fit を適切に実行できない場合、CPLD Fitter レポートが表示されない (Xilinx Answer 17973)
(SP1) 6.1i ISE - テストベンチが認識されず、Project Navigator の [Sources in Project] ウィンドウに表示されない (Xilinx Answer 18348)
(SP1) 6.1i ISE - ePD3.0 から EDIF ファイルを追加すると Project Navigator でエラーが発生する (Xilinx Answer 18684)

PROMGen

(SP3) 6.2i PROMGen - JDRIVE、ATE、またはサードパーティのプログラマで「ISC file is invalid or DATA_CRC checksum is incorrect」というメッセージが表示される (Xilinx Answer 19372)

シミュレーション

(SP3) 6.2i SP2 UniSim、Virtex-II Pro X/RocketIO X - ビヘイビア シミュレーション中、PMARXLOCK が X になる (Xilinx Answer 19425)

スピード ファイル

(SP) 6.2i スピード ファイル/Timing Analyzer/trce - Spartan-3 の場合、差動ペア P および N のタイミングが異なる (Xilinx Answer 19472)
(SP3) 6.2i Spartan-3 スピード ファイル/タイミング - 1.32 バージョンの変更内容について (Xilinx Answer 19475)
(SP2) 6.2i スピード ファイル/Virtex-II Pro X - MGT10 の遅延について (バージョン 1.86 へのアップデート) (Xilinx Answer 19250)
(SP2) 6.2i SP2 スピード ファイル - ISE で Virtex/-II および Spartan-II/-3 デバイス ファミリ用にインストールされているスピード ファイル (Xilinx Answer 12201)

StateCAD

(SP1) 6.1i SP3 StateCAD - ステート ダイアグラムを開くと「File Corrupted: Invalid (object/action) operators read from file [vetarget], [synopsis]」というエラー メッセージが表示される (Xilinx Answer 18628)

タイミング

(SP3) 6.2i Timing Analyzer/TRCE/PAR - ランタイムが長くなりすぎるか、「ERROR:Portability:3 This Xilinx application has run out of memory...」というエラー メッセージが表示される (Xilinx Answer 11749)
(SP3) 6.2i Timing Analyzer/スピード ファイル/TRACE - フィードバック パスで Duty Cycle Distortion マクロを使用すると Tdcmino が正しく算出されない (Xilinx Answer 19476)
(SP2) 6.2i Timing Analyzer/Spartan-3 - Spartan-3 の Tdcmino 値が小さすぎる (Xilinx Answer 19251) を参照してください。

XPower

(SP3) 6.2i XPower - 単一のマルチギガビット トランシーバ (MGT) の消費電力が複数の MGT のと同じである (Xilinx Answer 19439)
(SP1) 6.2i XPower - Spartan-3 の Vccaux のデフォルト値が不正 (Xilinx Answer 18750)

XST

(SP3) 6.2i XST - EDK デザインで PLB IP インターフェイスを使用するとき、キャッシュのアドレスが不正にカウントされてしまう (Xilinx Answer 19194)
(SP3) 6.1i XST - VHDL/回路図のコンポーネントの属性が、インスタンスの属性より優先されてしまう (Xilinx Answer 18350)
(SP3) 6.2i XST - Spartan-3 のタイミングに対し LUT 遅延が考慮されない (Xilinx Answer 19264)
(SP3) 6.2i XST - XST で符号付演算に適切ではないロジックが生成される (Xilinx Answer 19187)
(SP3) 6.2i XST Virtex-II Pro X RocketIO X - VHDL で作成したトランシーバのデザインが動作しない (TXOUTCLK 信号が生成されない) (Xilinx Answer 19332)
(SP2) 6.1i XST - 符号付き整数で conv_std_logic_vector を使用するとロジックが正しく生成されない (Xilinx Answer 18673)
(SP2) 6.1i XST - VHDL/回路図コンポーネントの属性が、インスタンスの属性より優先されてしまう (Xilinx Answer 18350) を参照してください。
(SP2) 6.2i XST - Verilog パラメータのスライスに方向 [0:n] を指定して使用するとパラメータが不正に処理される (Xilinx Answer 19064)
(SP2) 6.2i XST - VHDL で制約の設定されていない配列のビットがスワップされる (LSB <=>MSB) (Xilinx Answer 19184)
(SP2) 6.2i XST - コードの行数が多いとランタイムが長くなる (Xilinx Answer 19185)
(SP2) 6.2i XST - 特定の演算条件下で不正なロジックが生成される (Xilinx Answer 19186)
(SP2) 6.2i XST - XST で符号付演算に適切ではないロジックが生成される (Xilinx Answer 19187)
(SP1) 6.1i XST - 「ERROR:NgdBuild:455 - logical net 'N17' has multiple drivers/ERROR:NgdBuild:466 - input pad net 'N17' has illegal connection」というエラー メッセージが表示される (Xilinx Answer 13206)
(SP1) 6.1i XST - 符号付きの数値を含む式に対して不正なロジックが生成される (Xilinx Answer 18947)
(SP1) 6.2i XST - XST での syn_encoding のサポートについて (Xilinx Answer 18966)
(SP1) 6.2i XST - 「ERROR:Xst:1548 - file.vhd line xx: Negative range in type of signal <h> is not supported」というエラー メッセージが表示される (Xilinx Answer 18974)
(SP1) 6.2i XST - 複雑なクロックの式に対して不正なロジックが生成される (Xilinx Answer 18992)
(SP1) 6.2i XST - インクリメンタル合成で、ソース ファイルを変更した後 XST で最上位 NGC ファイルが再生成されない (Xilinx Answer 18494)
AR# 19001
日付 04/27/2006
ステータス アーカイブ
種類 一般
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