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AR# 20222

PowerPC SmartModel - 「** Note (SmartModel): UTLB has been flash invalidated」というメッセージが表示される

説明

キーワード : PPC405, simulation, timing, memory model, UniSim, SimPrim, UTLB, Flash, invalidated, SWIFT, EDK, simulate, シミュレーション, タイミング, メモリ モデル

PowerPC でシミュレーションを実行していると、次のようなメッセージが表示されます。

''# ** Note (SmartModel):
# UTLB has been flash invalidated
# Time: 77050000 ps Instance:/ppc_tbtop/i0/ppc405_0/ppc405_0/ppc405_i/ippc405_swift/ppc405_swift_inst''

これはどういう意味ですか。何故この問題が起きるのですか。またその解決方法は?

ソリューション

このメッセージは、統合された TLB (Translation Look-aside Buffer) が無効になっていることを示します。 TLB の詳細は、『Power PC Processor Reference Guide』 (UG011) の「Virtual-Memory Management」の章を参照してください。
http://xwebpub/xlnx/xweb/xil_publications_display.jsp?category=User+Guides&iLanguageID=2

このガイドにアクセスするには [すべてのユーザー ガイド] をクリックしてください。

PowerPC コアへの入力のステートが不明になると、「UTLB has been flash invalidated」というメッセージが表示されます。

このメッセージは、論理シミュレーション、構造シミュレーション、またはタイミング シミュレーションを実行していたり、タイミング チェックまたはタイミング情報 (エンベデッド PowerPC シミュレーション用にサードパーティから入手) が含まれた外部メモリ モデルを使用しているときに表示されます。

この問題は、タイミングがあまり重要ではない論理シミュレーションまたは構造シミュレーションを実行するときに、シミュレータでタイミング チェックをオフにしておくと解消できます。 詳細はベンダーの資料を参照してください。

タイミング情報が含まれたメモリ モデルを使用してタイミング シミュレーションを実行していると、セットアップ タイムおよびホールド タイムが違反になることがあるので、これを修正する必要があります。 適正な制約が使用されていること、デザインのタイミングが満たされていることを確認してください。
AR# 20222
日付 10/16/2008
ステータス アーカイブ
種類 一般
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