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AR# 20370

7.1i ISE Simulator (ISIM) - ISE Simulator の既知の問題

説明

キーワード: Simulation, problems, シミュレーション, 既知, 問題

重要度: 標準

概要:
このアンサーには、ISE 7.1i でリリースされた ISE Simulator の既知の問題が含まれています。

ソリューション

質問 1 : デザインに対して 60 秒以上シミュレーションを実行すると、ISE が停止し、クラッシュしたように見えます。
これはなぜですか。
回答 1 : これは、波形の保存方法に問題があるため発生します。 この問題は、ISE 8.1i の ISE Simulator で修正される予定です。

質問 2 : Shift キーを使用して複数の信号を選択し、、選択範囲内でクリックしてもビューアにすべての信号が追加されません。
回答 2 : これは、信号選択機能に問題があるため発生します。 複数の信号を選択する場合、選択したものをすべてビューアに移動するには、選択範囲内の最後の信号をクリックする必要があります。 この問題は、ISE 8.1i で修正するため、現在調査中です。

質問 3 : 階層ビューにパラメータやジェネリックを表示できません。 シミュレータからこの情報にアクセスする方法はありますか。
回答 3 : 現在のところ、ISE Simulator では、パラメータやジェネリックが表示されません。 情報は、シミュレータに読み込まれますが、表示はされません。 この問題は、ISE 8.1i リリースで修正される予定です。

質問 4 : パッケージ ファイルにテストベンチ波形を追加できません。 TBW ファイルが生成されず、プロセスが停止してしまいます。
回答 4 : テストベンチ波形は、パッケージに追加できないことになっているのですが、 ISE では、パッケージを選択してテストベンチ波形を生成するようになっているため、この問題が発生します。 この問題は、8.1i ソフトウェア リリースで修正される予定です。

質問 5 : ISE サービス パックをインストールした後、デザインが正しくシミュレーションされません。
回答 5 : サービス パックをインストールした後に、プロジェクト ファイルをクリーンアップしてから、デザインを実行する必要があります。 プロジェクト ファイルをクリーンアップするには、Project Navigator で [Project] -> [Cleanup Project Files] をクリックします。

質問 6 : 「help」と入力した場合と「HELP」と入力した場合で、ISE Simulator のコンソール ウインドウに表示される内容が異なります。
回答 6 : これは、Windows 環境における TCL の既知の問題です。 ISE Simulator のコンソールの TCL インターフェイスでは、有効なシステム環境コマンドとシミュレーションのコマンドの両方がサポートされています。 したがって、「HELP」 と入力した場合は Windows のシステム ヘルプ コマンドにアクセスし、「help」 と入力すると ISE Simulator ヘルプにアクセスします。 この問題を修正する予定はありません。

質問 7 : ISE Simulator は、構造的シミュレータとして最適化されていないため、一部の構造的ネットリスト (変換後/MAP 後/PAR 後) を使用すると、コンパイル中に最大限度に達してしまいます。
回答 7 : この問題を回避するには、ネットリストの階層を維持してください。 詳細は、『合成/検証デザイン ガイド』を参照してください。
http://toolbox.xilinx.com/docsan/xilinx7j/books/docs/sim/sim.pdf

質問 8 : ISE Simulator の HDL Editor で、ジェネリックとパラメータがサポートされません。 最上位ファイルにジェネリックまたはパラメータがある場合、テストベンチ波形に使用されません。
回答 8 : この機能は、 8.1i ソフトウェア リリースの ISE Simulator の HDL Editor でサポートされる予定です。

質問 9 : コンソール ウインドウの Step コマンドを実行すると、新しいファイルが開いて、HDL Editor ウインドウがアクティブになります。
回答 9 : これは、ISE Simulator の限界です。 この問題を回避するには、[step] ボタンを使用するか (ISE Simulator ヘルプを参照)、コンソール ウィンドウに戻ってください。 この問題は、ISE 8.1i で修正される予定です。

質問 10 : コンソール ウインドウで Step コマンドを実行すると、存在しないファイルが認識され、このファイルが存在しないことを示すメッセージが複数表示されます。
回答 10 : この問題を回避するには、このファイル以降のポイントからシミュレーションを実行します。 この問題は、ISE 8.1i で修正される予定です。

質問 11 : 双方向ポートのみを含むデザインで [Generate Expected Simulation Results] を使用しても、何も起きません。
回答 11 : 双方向ポートがあると、[Generate Expected Simulation] は機能しません。 この問題は、9.1i ソフトウェア リリースで修正される予定です。

質問 12 : 名前にスペースが含まれたディレクトリに ISE をインストールすると、ISE Simulator でエラーが発生します。
回答 12 : ザイリンクスのインストール ディレクトリ名にスペースが含まれていると、ISE Simulator は動作しません。 ISE 8.1i で修正される予定です。

質問 13 : 回路図デザインで生成した HDL 言語を Verilog から VHDL または VHDL から Verilog に変更できません。
回答 13 : (Xilinx Answer 20995) を参照してください。

質問 14 : テストベンチの終わりを 500,000ns のような高い数値に設定すると、ISE が停止し、クラッシュします。
これはなぜですか。
回答 14 : これは、波形の保存方法に問題があるため発生します。 メモリ リークが発生しています。 この問題は、 8.1i の ISE Simulator で修正される予定です。

質問 15 : 管理者権限がないと、ISE Simulator の GUI が起動されません。
回答 15 : (Xilinx Answer 21126) を参照してください。

質問 16 : 再起動すると、ISE Simulator が安定した動作をせずに、不正な結果を表示します。
回答 16 : これは、ISE Simulator の既知の問題です。 ISE 8.1i で修正される予定です。

質問 17 : ISE Simulator で [Generate Expected Results] が正しく機能しません。
回答 17 : [Generate Expected Simulation Results] では、自己診断テストベンチが出力され、シミュレーションでこれらの出力がチェックされることになっていますが、 このフローが適切に機能しません。 この問題は、ISE 8.1i で修正される予定です。

質問 18 : Run コマンドの前に Step コマンドを入力すると、0ns までしか実行されず、初期化が終了したことを示すメッセージが表示されます。
回答 18 : (Xilinx Answer 21633) を参照してください。

質問 19 : 出力された VHDL ファイルで、ライブラリ宣言に余分なピリオド (.) が表示されます。
回答 19 : (Xilinx Answer 21880) を参照してください。

質問 20 : テストベンチ波形が双方向ポートで動作しません。
回答 20 : (Xilinx Answer 21900) を参照してください。

質問 21 : テストベンチ波形が非同期入力で動作しません。
回答 21 : 入力信号が非同期に設定されている場合、入力値は生成されたテストベンチに正しく記述されません。 この問題を回避するには、クロック入力の 1 つに入力を同期化させます。 ISE 8.1i で修正される予定です。

質問 22 : テストベンチ波形パターン ウィザードでは、パターンの末尾に乱数が追加されます。
回答 22 : 波形生成ツールで特定の乱数を加えないパターンを使用すると、このパターンが乱数ではないパターンに変換されます。このとき、変換されたパターンが乱数のように見えます。 この問題は、現在のところ調査中です。
AR# 20370
日付 11/13/2007
ステータス アーカイブ
種類 一般
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