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AR# 21399

LogiCORE PCI/PCI-X - Virtex-4 PCI 66MHz および PCI-X 133MHz デザインのタイミングが満たされない

説明

キーワード : input setup, period, clock nub, PCLK, ALL_BUS, CLK_NUB, XPCI_WRAP, 入力セットアップ, 周期, クロック, タイミング

PCI 66MHz デザインまたは PCI-X 133MHz デザインをインプリメントすると、一部の OFFSET IN 制約が満たされません。

ソリューション

製品デバイスで発生していたタイミング問題は、7.1i サービス パック 4 で修正されています。 ISE ソフトウェア アップデートの最新バージョンをダウンロードして、CORE Generator に含まれる最新バージョンの PCI および PCI-X コアを入手してください。

LX および SX の PCI 66MHz および PCI-X 133MHz デザインでは、タイミングを満たすためにデバイスのステップ レベルを 1 に設定する必要があります。 これには、UCF ファイルに次の構文を追加します。

CONFIG STEPPING = ''1'';

ザイリンクスでは、ステップ レベルを 1 に設定して PCI および PCI-X コアを使用すると、次のパーツでタイミングが満たされることを確認しました。

PCI コア (66MHz)

4VLX25-FF668-11
4VSX35-FF668-11
4VFX20-FF672-11

PCI コア (33MHz)

4VLX25-FF668-10
4VSX35-FF668-10
4VFX20-FF672-10

PCI-X コア (133MHz)

4VLX25-FF668-10
4VSX35-FF668-10
4VFX20-FF672-10

メモ : 4VFX20-FF672 デバイスをターゲットとした PCI 66MHz デザインでは、デバイスのステップ レベルを ES または 0 に設定するとタイミングが満たされます。 PCI 33MHz の制約は、LX および SX SCD ステップ ES とステップ 0 デバイスで満たされます。

ステップ レベルの詳細は、(Xilinx Answer 21605) を参照してください。

CORE Generator から起動可能な PCI/PCI-X UCF Generator で UCF ファイルを生成し、上記にリストされたデバイス以外のデバイスも使用できます。

次のサイトから最新の IP アップデートをダウンロードします。
http://www.xilinx.co.jp/xlnx/xil_sw_updates_home.jsp

生成された UCF ファイルがタイミング要件を満たしていることを確認する必要があります。 また、これらのファイルでステップ レベルが正しく設定されていることを確認してください。

PCI コアは、LX および SX SCD ステップ ES とステップ 0 デバイスでの完全な 66MHz 動作をサポートしません。 プロトタイプとラボ環境で、これらのデバイスを使用できますが、すべてのタイミング制約が満たされるわけではないことをご了承ください。 これらのデバイスでは、一部のパスで OFFSET IN 制約が満たされません。

PCI 66MHz を使用した Virtex-4 デザインでのタイミング クロージャを達成する手法については、 (Xilinx Answer 22921) を参照してください。
AR# 21399
日付 12/15/2012
ステータス アクティブ
種類 一般
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