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AR# 21982

LogiCORE Dual Port Block Memory v6.3 および Single Port Block Memory v6.2 - 「ERROR:PhysDesignRules:1088 - Dangling pins on block:<blkmemv2_dp...>」というエラー メッセージが表示される

説明

キーワード : COREGen, CORE Generator, dual, port, block, memory, BRAM, block RAM, ramb16, dp, blkmem, parameters, BitGen, DRC, デュアル, ポート, ブロック メモリ, パラメータ


重要度 : 標準

概要 :
Dual Port Block Memory および Single Port Block Memory のカスタマイズ GUI で、無効なパラメータが選択できてしまいます。

たとえば、ポート A を [Write Only] に設定すると、ポート A の出力レジスタをオプションで選択できなくなってしまいます。
また、ポート A を [Read Only] に設定すると、ポート A の入力レジスタまたはライト イネーブル オプションを選択できなくなってしまいます。

これらの無効なパラメータを選択すると、未接続のレジスタを使用するコアが生成されます。 これらのレジスタは、ISE 7.1i の DRC (デザイン ルール チェック) で検知されませんが、ISE 8.1i 以降の BitGen で DRC を実行するときに検知されます。 DRC で次のエラー メッセージが表示されます。

"ERROR:PhysDesignRules:1088 - Dangling pins on
block:<blkmemv2_dp_v6_3_sym_combd61341_1_top/BU50/blkmemv2_dp_v6_3_sym_combd6 1341_1_top/BU50>:<RAMB16_RAMB16>. If port B is used the CLKB DIB0 and at least one address pin ADDRB8-ADDRB13 must be used."

ソリューション

上記のような DRC エラーが発生する場合は、不正なパラメータ設定でコアが生成されていないかどうか XCO ファイルを確認してください。 不正なパラメータ設定でコアが生成されている場合は、そのパラメータを使用しないでコアを生成し直してください。

Dual Port Block Memory コアの場合 :
GUI の 1 ページ目の [Port A Options] で [Write Only] をオンにすると、2 ページ目の [Output Register Options] は変更できないはずなのに、実際には変更できてしまいます。

GUI の 1 ページ目の [Port A Options] で [Read Only] をオンにすると、2 ページ目の [Register Inputs] は変更できないはずなのに、実際には変更できてしまいます。 2 ページ目のライト イネーブル信号 Active High/Active Low は変更できません。

GUI の 1 ページ目の [Port B Options] で [Write Only] をオンにすると、3 ページ目の [Output Register Options] は変更できないはずなのに、実際には変更できてしまいます。

GUI の 1 ページ目の [Port B options] で [Read Only] をオンにすると、3 ページ目の [Register Inputs] は変更できないはずなのに、実際には変更できてしまいます。 3 ページ目の [Write Enable Active High/Active Low] は、オプションでは可能になっていますが変更できません。

[Write Only] または [Read Only] のポートを選択する場合は、上記に示されたパラメータ設定を変更せず、デフォルトの設定のままにしてください。

AR# 21982
日付 12/15/2012
ステータス アクティブ
種類 一般
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