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AR# 23208

8.2i NetGen、タイミング シミュレーション - NetGen の既知の問題

説明

キーワード : simulate, TRACE, TRCE, anno, mismatch, problems, シミュレーション, 不一致, 問題

このアンサーには、NetGen 8.2i の既知の問題が記載されています。

ソリューション

質問 1 : 以前のバージョンに比べて、NetGen のランタイムが長く、より多くのメモリが使用されてしまいます。
回答 1 : (Xilinx Answer 21749) を参照してください。

質問 2 : X_SFF の S パッドから S ピンの遅延が TRACE と SDF 間で一致しません (Spartan-3E)。
回答 2 : この問題は 8.2 サービスパック 2 で修正されています。

質問 3 : X_FF を解析したときに Tgck が TRACE と SDF 間で一致しません (Spartan-3E)。
回答 3 : この問題は 8.2 サービスパック 2 で修正されています。

質問 4 :IOB X_SFF のセットアップが調整されません (Spartan-3E)。
回答 4 : この問題は、 9.1 で修正されています。

質問 5 : X_SFF の R wrt CLK のセットアップ遅延が TRACE と SDF 間で一致しません (Virtex-4)。
回答 5 : この問題は現在調査中です。

質問 6 :RAM32X1S - RAM32X1S] のパスが TRACE と SDF 間で一致しません (Virtex-4)。
回答 6 : この問題は現在調査中です。

質問 7 : TRACE と SDF 間の遅延がクロック ネットワークの遅延に一致しません (Virtex-II Pro)。
回答 7 : この問題は現在調査中です。

質問 8 : X_FDDRRSE のセットアップが正しく調整されません (Spartan-3E)。
回答 8 : この問題は現在調査中です。

質問 9 : RAM16X1S テスト ケースのセットアップが正しく調整されません (Virtex-4)。
回答 9 : この問題は現在調査中です。

質問 10 : GT のセットアップ調整が 100ps ずれます (Virtex-II Pro)。
回答 10 : この問題は現在調査中です。

質問 11 : X_IDELAY でアノテートされた遅延が Tidid と一致しません (Virtex-4)。
回答 11 : この問題は現在調査中です。

質問 12 : IOBDELAY_VALUE が 0 でない場合、ISERDES で不正なセットアップ チェックおよびホールチェックが表示されます。
回答 12 : (Xilinx Answer 22526) を参照してください。

質問 13 : STARTUP ブロックを使用した場合、NetGen で GSR が正しく接続されません。
回答 13 : この問題は現在調査中です。
AR# 23208
日付 03/27/2009
ステータス アーカイブ
種類 一般
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