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AR# 23884

v2.5 CORE Generator Aurora - リリース ノートと既知の問題

説明

キーワード : CORE Generator


このアンサーには、v2.5 CORE Generator Aurora のリリース ノートおよび既知の問題が記載されています。

ソリューション

新機能

- ISE 8.2i 用にアップデート
- Virtex-4 FX CES4 キャリブレーション ブロック、リセット ロジック、およびアナログ パラメータ設定を追加
- シンプレックス パートナー テスト オプションの改良

Virtex-4 の修正点

- ライン レートの値が 2.5 Gbps 未満のときに Refclk 周波数が正しく計算されない問題を修正
- Virtex-4 で生成された Aurora コアでループバック ポートが接続されない問題を修正
- ライン レートの値が 1.25 Gbps 以下のときに Virtex-4 のクロック設定が不正になる問題を修正

Virtex-II Pro/Virtex-II Pro X の修正点

- CHBONDI-CHBONDO パスに信号拡張レジスタが挿入されているため、MGT の両方の行を使用したチャネル ボンディング デザインで、Virtex-II Pro Aurora コアが正しく生成されない
- Virtex-II Pro X のステッピング 0 デバイスで、Aurora コアのクロック コレクション挿入ファンクションによりデータが破損する問題を修正

一般的な修正

- ターゲット デバイスおよび HDL の値がプロジェクト設定から決定されるよう修正
- 配置で 4 レーンと指定されていても、GUI で5 レーンのモジュールが生成できてしまう問題を修正
- SIMPLEX_PARTNER シミュレーション スクリプトおよびテストベンチ モジュールのエラーを修正
- COMBUS コンフィギュレーションがチャネル ボンディングと互換していなかった問題を修正
- Error_detect モジュールで、ソフト エラー シーケンスのエラーが正しくカウントされない問題を修正
- フロー制御が指定されていないと、不要な Rx_ll_ufc_datapath モジュールが生成される問題を修正
- 複数レーンの Aurora コアで、TX システム リセット制御により TXLOCK 信号が 1 つしか監視されず、デザインの一部分が TXLOCK の受信前に実行される可能性がある問題を修正

既知の問題

- ありません。
AR# 23884
日付 12/15/2012
ステータス アーカイブ
種類 一般
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