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AR# 23985

LogiCORE Block Plus Endpoint for PCI Express v1.1 - 8.2i IP アップデート 2 LXT 補足 (8.2i_IP2_LXTsup) のリリース ノートおよび既知の問題

説明

キーワード : コア, COREGen, CORE Generator, LXT, Virtex-5, Block, Hard, リリース ノート, 既知の問題

このアンサーでは、LogiCORE Block Plus Endpoint for PCI Express v1.1. のリリース ノートの内容を示します。

ソリューション

LogiCORE Block Plus Endpoint for PCI Express v1.1 の初期リリース

CORE Generator アップデート (8.2i IP アップデート 2 LXT 補足) には PCI Express Endpoint Block Plus LogiCORE v1.1 の初期リリースが含まれています。このリリースをダウンロードし、すでにインストールされている 8.2i SP3 IP アップデート 2 に上書きするようにインストールする必要があります。 このアップデートに関する一般的な情報は、(Xilinx Answer 24008) を参照してください。 入手先は次のとおりです。
http://japan.xilinx.com/xlnx/xil_sw_updates_home.jsp

一般情報

Virtex-5 LXT デバイスには、専用の PCI Express Endpoint Block が含まれています。 Virtex-5 LXT の PCI Express Endpoint Block を使用する場合は、CORE Generator で生成される 2 つのラッパ ファイルのいずれかを使用することをお勧めします。 2 つのラッパ ファイルには、それぞれ独自の機能があります。 ラッパの詳細は、次の Web サイトを参照してください。
http://japan.xilinx.com/ipcenter/V5LXT_pcie_ep_sel_guide/index.htm

既知の問題

-- -1 スピードグレードを使用すると、トランザクション インターフェイスの周波数が 250 MHz である x4 または x8 コア デザインのインプリメンテーションまたは PCI Express ブロックと GTP トランシーバ間の 250 MHz インターフェイスでタイミング エラーが発生することがあります。 トランザクション インターフェイスのクロック ドメインは、システム リファレンス クロックとは異なる点に注意してください。 システム リファレンス クロック入力の周波数 (100MHz または 250MHz) にかかわらず、トランザクション インターフェイスの周波数には 125MHz または 250MHz を使用できます。 トランザクション インターフェイスのクロック周波数の選択については、生成したコアの doc ディレクトリにある『PCI Express Endpoint Block Plus User's Guide』 (pcie_blk_plus_ug341.pdf) を参照してください。 この問題は、ISE 9.1i IP アップデート 1 コア リリースで修正される予定です。

-- IO 空間の BAR をインプリメントするデザインで、NetGen でのコアのシミュレーション モデルの作成に問題があるため、シミュレーションが正しく実行できません。 この問題は、9.1i ソフトウェア リリースで修正される予定です。 これはシミュレーションのみの問題で、ハードウェアの動作には影響しません。

-- CORE Generator で「ERROR:coreutil - Failure to generate output products」というエラー メッセージが表示された場合は、(Xilinx Answer 24174) を参照してください。
AR# 23985
日付 12/15/2012
ステータス アクティブ
種類 一般
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