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AR# 30295

10.1 EDK、MPMC v4.00.a - BitGen で MIG Spartan-3 PHY に対して未接続ピンおよびゲート クロックに関する警告メッセージが表示される

説明

キーワード : warning, PhysDesignRules, 372, 1060, gated, clock, 警告, ゲート, クロック

Spartan-3 MPMC デザインで BitGen を実行してビットストリームを生成しているときに、次の警告メッセージが複数表示されます。これらのメッセージは無視できますか。

Running DRC.
WARNING:PhysDesignRules:372 - Gated clock. Clock net
mpmc_core_0/gen_s3_ddr_phy.mpmc_phy_if_0/data_path/dqs_de
layed_col0<1> is sourced by a combinatorial pin. This is not good design
practice. Use the CE pin to control the loading of data into the flip-flop.
WARNING:PhysDesignRules:1060 - Dangling pins on
block:<mpmc_core_0/mpmc_data_path_0/gen_write_fifos[0].ge
n_fifos.mpmc_write_fifo_0/gen_fifo_bram.mpmc_bram_fifo_0/gen_brams_normal.gen
_normal.gen_brams[0].bram/gen_ramb16_s36_s36.bram/DDR_SDRAM/DDR_SDRAM/mpmc_co
re_0/mpmc_data_path_0/gen_write_fifos[0].gen_fifos.mpmc_write_fifo_0/gen_fifo
_bram.mpmc_bram_fifo_0/gen_brams_normal.gen_normal.gen_brams[0].bram/gen_ramb
16_s36_s36.bram.A>:<RAMB16_RAMB16A>. The block is configured to use input
parity pins. There are dangling output parity pins.
DRC detected 0 errors and 5 warnings.
Creating bit map...
Saving bit stream in "system.bit".
Bitstream generation is complete.
Done!

ソリューション

このエラー メッセージは無視しても問題がありません。これらの警告メッセージは、MIG Spartan-3 PHY で使用されるダイナミック LUT の遅延チェーンが原因で表示されます。
AR# 30295
日付 02/22/2008
ステータス アクティブ
種類 一般
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