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AR# 32164

Virtex-5 GTX RocketIO - CLK_COR_ADJ_LEN = 1 または 3 の場合、非同期動作中にデータ エラーが発生する

説明

キーワード : clock correction, RXDATA, RXCLKCORCNT, error, クロック コレクション, エラー

Virtex-5 GTX トランシーバのクロック コレクション機能を使用すると、クロック コレクション シーケンスがスキップされたり追加されたときにレシーバでデータが破損する可能性があります。クロック コレクション機能の詳細は、『Virtex-5 FPGA RocketIO GTX Transceiver User Guide』 (UG198) を参照してください。

この問題は、次の条件がすべて揃うと発生します。

- 非同期動作 : Virtex-5 GTX トランシーバのローカル リファレンス クロックが最遠のトランシーバ以外のオシレータで駆動されている場合。これによりトランシーバの動作周波数間に PPM オフセットが発生し、クロック コレクションで定期的にクロック コレクション シーケンスをスキップしたり追加したりすることが必要となります。また、これは Virtex-5 GTX トランシーバの RXUSRCLK および RXUSRCLK2 ポートが RXRECCLK ポートからではなく、ローカル オシレータから派生していることも示します。

- クロック コレクションがイネーブル : CLK_CORRECT_USE_0/1 属性が TRUE に設定されている場合。

- クロック コレクション シーケンスの長さが 1 または 3 バイト : CLK_COR_ADJ_LEN_0/1 属性が 1 または 3 に設定されている場合。


上記の条件がすべて満たされる場合、Virtex-5 GTX トランシーバのクロック コレクション機能をディスエーブルにする必要があります。このアンサーでは、可能な回避策を示します。

ソリューション

アプリケーションで可能な場合、次のいずれかの回避策をインプリメントします。

- 同期クロック供給を使用します。
- 2 バイトまたは 4 バイトのクロック コレクション シーケンスに変換します。

レイアウトまたはプロトコルの制限によりこれらの回避策を適用できない場合は、ユーザー アプリケーションで次のサイトから入手可能なファブリック クロック コレクション モジュールをインプリメントする必要があります。
https://secure.xilinx.com/webreg/clickthrough.do?cid=115636

このブロックをインスタンシエートする手順とファブリック使用率の予測は、次のサイトから『Virtex-5 FPGA RocketIO GTX Transceiver Clock Correction Module』 (XTP037) を参照してください。
http://japan.xilinx.com/support/documentation/sw_manuals/xtp037.pdf

この問題の影響を受ける IP は、次のアンサーを参照してください。
- XAUI : (Xilinx Answer 32539)
- PCIe Gen1 : (Xilinx Answer 32270)
- SRIO : (Xilinx Answer 32188)

この問題が発生する可能性のあるその他のプロトコル :
- Infiniband
- PCIe Gen2

よく寄せられる質問 (FAQ) :
質問 : Aurora はこの問題の影響を受けますか。
回答 : いいえ、Aurora では 2 バイト クロック コレクション シーケンスが使用されます。

質問 : GTP はこの問題の影響を受けますか。
回答 : いいえ、GTP では異なるクロック シーケンス回路が使用されており、この問題は発生しません。

質問 : Virtex-6 GTX はこの問題の影響を受けますか。
回答 : いいえ、GTX ではこの問題は発生しません。


質問 : この問題の影響を受ける IP はいつアップデートされますか。
回答 : 各ザイリンクス IP については、前述のアンサーを参照してください。RocketIO Wizard はファブリック モジュールを使用する回避策を適用して 11.2 でアップデートされ、必要に応じてプロトコル テンプレートに属性の変更が適用される予定です。
AR# 32164
作成日 03/11/2009
最終更新日 04/30/2009
ステータス アクティブ
タイプ 一般