AR# 38181

Architecture Wizard - カスケードされた DCM の RST ポートでグリッチが発生

説明

カスケードされた DCM のウィザードの 1 つ使用し、デザインに必要なクロック周波数を生成するカスケード DCM ソリューションを構築しました。しかし、デザインをシミュレーションすると、論理およびタイミング シミュレーション中に次のエラー メッセージが表示されます。

Error: Input Error : RST on DCM_?SP must be asserted for 3 CLKIN clock cycles.

リセット ピンに必要なロジックは問題なくインプリメントされていることが確認できています。

このグリッチはハードウェアで問題になりますか。この問題の回避策を教えてください。

ソリューション

2 つ目の DCM のソースが最初の DCM の DLL 出力の 1 つである場合に、この状況が発生します。

この問題を解決するには、次の手順に従いします。

1) XAW ファイルをデザインで使用している場合は、このファイルを削除して、代わりに同等の HDL を追加します。
2) OR2 ゲートの出力と、カスケードされた DCM の RST ピンの間に FD プリミティブを挿入します。

フリップフロップを追加すると、リセット ロジックにより追加されたグリッチが DCM のリセット ピンに伝搬されなくなります。


AR# 38181
日付 01/05/2011
ステータス アーカイブ
種類 一般
デバイス 詳細 概略