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AR# 38552

PCI Express のデザイン アシスタント - trn_tdst_rdy_n が恒久的にディアサートされる

説明

trn_tdst_rdy_n が恒久的にディアサートされたり、長時間ディアサートされたりすることがあるのはなぜですか。

メモ : このアンサーは PCI Express ザイリンクス ソリューション センター (ザイリンクス アンサー 34536) の一部です。PCI Express のザイリンクス ソリューション センターでは PCIe に関する質問に対する回答を一覧できます。PCIe でデザインを新しく作成する場合、または問題をトラブルシュートする場合は、このザイリンクス PCI Express ソリューション センターから情報を入手してください。

ソリューション


trn_tdst_rdy_n 信号は、コアでこれ以上のデータを受信する準備ができていないことを示します。状況によって、trn_tdst_rdy_n が恒久的にディアサートされたり、長時間ディアサートされたりすることがあります。

この信号は内部ブロック送信バッファーがフルになるとディアサートされ、ユーザー アプリケーションからこれ以上のパケットを受信できません。これは通常、リンク パートナーからのフロー制御クレジット アップデートの返信が停止した場合に発生します。リンク パートナーからのフロー制御クレジット アップデートの返信が停止すると、クレジットが解放されるまでエンドポイントからこれ以上のパケットを送信できません。

リンク パートナーからのフロー制御クレジット アップデートの返信が停止するのは、エラー状態が発生している場合などです。生成した TLP が不正な形式でないことを確認してください。スイッチとインターフェイスしていて、スイッチで不正な形式の TLP が受信されると、フロー制御クレジットがアップデートされない場合があります。これにより、コアからのパケット送信が停止します。

改訂履歴
2011 年 7 月 29 日 - 初期リリース

アンサー レコード リファレンス

関連アンサー レコード

Answer Number アンサータイトル 問題の発生したバージョン 修正バージョン
36049 PCI Express のデザイン アシスタント - TRN ユーザー アプリケーション インターフェイスに関する質問 N/A N/A
AR# 38552
作成日 07/29/2011
最終更新日 12/15/2012
ステータス アクティブ
タイプ 一般
IP
  • Virtex-6 FPGA Integrated Block for PCI Express ( PCIe )
  • Endpoint Block Plus Wrapper for PCI Express
  • Spartan-6 FPGA Integrated Endpoint Block for PCI Express ( PCIe )