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AR# 38571

Virtex-6 GTH Transceiver - Manually setting the tap values for the DFE

説明

This Answer Record contains the bit mappings for the DFE taps in the Virtex-6 GTH Transceiver.  

ソリューション

The DFE in the Virtex-6 GTH Transceiver has three taps.

The table below contains the bit mappings for these taps; the bits that enable overriding the auto-calibration, and the equalization gain settings.



DFE Impact

Attribute Location:

Tap 1 Value [4:0]:

RX_AEQ_VAL1_LANE[4:0]

Tap 1 Override:

RX_AEQ_VAL1_LANE [5]

Tap 2 Value [4:0]:

RX_AEQ_VAL1_LANE [10:6]

Tap 2 Override:

RX_AEQ_VAL1_LANE [11]

Tap 3 Value [4]:

RX_AEQ_VAL0_LANE [0]

Tap 3 Value [3:0]:

RX_AEQ_VAL1_LANE [15:12]

Tap 3 Override:

RX_AEQ_VAL0_LANE[1]

DFE Gain:

RX_AEQ_VAL0_LANE[5:4]

AGC Gain:

RX_AEQ_VAL0_LANE[3:2]


NOTE: Xilinx is only providing these bit locations for users who are interested in setting the feedback taps themselves.

Performance while manually modifying these bits depends on the use model.

For supported DFE use cases, see the Virtex-6 GTH Transceiver User's Guide (UG371).

アンサー レコード リファレンス

関連アンサー レコード

Answer Number アンサータイトル 問題の発生したバージョン 修正バージョン
37414 Virtex-6 GTH トランシーバー - ES シリコンの属性アップデート N/A N/A
38596 Virtex-6 FPGA GTH トランシーバー - 既知の問題のアンサー リスト N/A N/A
AR# 38571
日付 06/23/2017
ステータス アクティブ
種類 一般
デバイス
  • Virtex-6 CXT
  • Virtex-6 HXT