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AR# 38651

MIG 3.6 Spartan-6 - DDR 終端に関する推奨事項

説明

DDR メモリーでは ODT (on-die termination) がサポートされていないため、外部メモリー終端を提供する必要があります。Spartan-6 FPGA ではキャリブレートされた入力終端またはキャリブレートされていない入力終端をオプションで選択することができます。MIG では、Spartan-6 FPGA に対しこのオプションを選択することができるようになっているのですが、これらのオプションを選択するとデザインが機能しなくなります。このため、MIG の [FPGA Options] で [External Input Termination] しか選べなくなっています。

ソリューション


DDR メモリーでは ODT (on-die termination) がサポートされていないため、外部メモリー終端を提供する必要があります。外部メモリ終端は関連メモリー コンポーネントの後にフライバイで配置する必要があります。

PCB レイアウトに関する詳細は、『Spartan-6 FPGA Memory Controller User Guide』 (UG388)を参照してください。
http://japan.xilinx.com/support/documentation/user_guides/ug388.pdf

DDR には外部終端が必要なため、Spartan-6FPGA には内部終端は選択しないでください。DDR インターフェイスには、MIG 3.6 の [FPGA Options] で [External Input Termination] を選択する必要があります。今後リリースされる MIG では、キャリブレートされた入力終端またはキャリブレートされていない入力終端を選択するオプションが無効になる予定です。

アンサー レコード リファレンス

関連アンサー レコード

Answer Number アンサータイトル 問題の発生したバージョン 修正バージョン
40778 MIG Spartan-6 MCB - 終端および I/O 規格のガイドライン N/A N/A
39128 MIG Virtex-6 および Spartan-6 v3.7 - ISE Design Suite 13.1 でのリリース ノートおよび既知の問題 N/A N/A
38951 MIG v3.61 - ISE Design Suite 12.4 ～ 14.2 でのリリース ノートおよび既知の問題 N/A N/A
AR# 38651
日付 03/04/2013
ステータス アクティブ
種類 一般
デバイス
IP
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