AR# 38731

MIG v3.5-v3.91、Virtex-6 DDR3 - シミュレーション - キャリブレーションを ''SKIP'' に設定するとサンプルデザインでエラーが発生する

説明

Virtex-6 MIG DDR3 v3.5 ～ v3.91 で、パラメーター SIM_BYPASS_INIT_CAL = "FAST" を設定すると、サンプルデザインのシミュレーションが高速になり、エラーなしでキャリブレーションされます。

SIM_BYPASS_INIT_CAL = ''SKIP'' を設定するとエラーが発生し、シミュレーションが停止します。

ソリューション

SIM_BYPASS_INIT_CAL = ''SKIP'' を設定すると、PHY でビットアライメントエラーが発生する可能性があります。

このエラーが発生すると、データ有効信号が 1 クロックサイクルのレイテンシで間違ってアサートされます。

この問題は、14.2 で修正される予定です。当面の間は、SIM_BYPASS_INIT_CAL パラメーターを "FAST" に設定してください。

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アンサーレコードリファレンス

マスターアンサーレコード

Answer Number	アンサータイトル	問題の発生したバージョン	修正バージョン
39128	MIG Virtex-6 および Spartan-6 v3.7 - ISE Design Suite 13.1 でのリリースノートおよび既知の問題	N/A	N/A
50642	MIG Virtex-6 および Spartan-6 v3.92 - ISE Design Suite 14.3 でのリリースノートおよび既知の問題	N/A	N/A

関連アンサーレコード

Answer Number	アンサータイトル	問題の発生したバージョン	修正バージョン
43130	MIG Virtex-6 および Spartan-6 v3.9 - ISE Design Suite 13.3 のリリースノートおよび既知の問題	N/A	N/A
41347	MIG Virtex-6 and Spartan-6 v3.8 - Release Notes and Known Issues for ISE Design Suite 13.2	N/A	N/A
39128	MIG Virtex-6 および Spartan-6 v3.7 - ISE Design Suite 13.1 でのリリースノートおよび既知の問題	N/A	N/A
38951	MIG v3.61 - ISE Design Suite 12.4 ～ 14.2 でのリリースノートおよび既知の問題	N/A	N/A
37173	MIG v3.6 - ISE Design Suite 12.3 でのリリースノートおよび既知の問題	N/A	N/A
45194	MIG Virtex-6 および Spartan-6 v3.91 - ISE Design Suite 13.4 でのリリースノートおよび既知の問題	N/A	N/A

AR# 38731
日付	08/20/2014
ステータス	アクティブ
種類	既知の問題
デバイス	Virtex-6 CXT Virtex-6 HXT Virtex-6 LX More Virtex-6 LXT Virtex-6 SXT Less
IP	MIG

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