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AR# 38848

Virtex-6 Integrated Block Wrapper v1.6 for PCI Express - UG517 の修正項目

説明

このアンサーには、『Virtex-6 Integrated Block Users Guide』 (UG517) の修正項目がリストされています。

ソリューション


2010 年 9 月 21 日付けのバージョン

108 ページ : 図 6-14 - trn_rbar_hit_n is の波形が正しくありません。 trn_rbar_hit_n は trn_rsof_n to trn_reof_n からのパケットでずっとアサートされる必要があります。

121 ページ : 図 6-29 - trn_teof_n のラベルが間違っています。正しくは trn_eof_n ではなく trn_teof_n です。

122 ページ : 図 6-30 の上にある文章「it also places a value of 01b on trn_trem_n[1:0].」の中の値は正しくは 10b です。

122 ページ : 図 6-31 - trn_trem_n[1:0] = 00 なのでtrn_teof_n サイクルで 4 つの DWORDS すべてが有効、とありますが、trn_td[127:0] の入力は「D1、D2、D3、D4」となります。

203 ページ : 表 7-2 - 脚注 3 は X0Y1 ブロックの HX565T-FF1923 エントリに該当します。x8 リンクはこのデバイスとパッケージの組み合わせで X0Y1 を使用した場合はサポートされません。

改定履歴
01/04/2011 - 203 ページのエントリを追加
11/01/2010 - 初期リリース

アンサー レコード リファレンス

マスター アンサー レコード

Answer Number アンサータイトル 問題の発生したバージョン 修正バージョン
37936 Virtex-6 FPGA Integrated Block Wrapper v1.6 for PCI Express - リリース ノートおよび既知の問題 N/A N/A

関連アンサー レコード

AR# 38848
日付 05/20/2012
ステータス アクティブ
種類 既知の問題
デバイス
  • Virtex-6 CXT
  • Virtex-6 HXT
  • Virtex-6 LX
  • More
  • Virtex-6 LXT
  • Virtex-6 SXT
  • Less
IP
  • Virtex-6 FPGA Integrated Block for PCI Express ( PCIe )
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