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AR# 42128

FPGA コンフィギュレーション - DONE が High になってからデバイスが正しく動作するまでに必要な CCLK のクロック サイクル数

説明

DONE が High になってから、FPGA デバイスが確実に正しく動作するまでに必要な CCLK のクロック サイクル数を教えてください。

ソリューション

コンフィギュレーションが完了すると、スタートアップ シーケンスにより DONE が High になります。

このステートは、BitGen の -g DONE_cycle オプションを使用して定義します。デフォルトでは、DONE はサイクル 4 で High になります。

DONE はコンフィギュレーションが完了し、すべてのデータが読み込まれたことを示しますが、スタートアップ シーケンスが正しく完了することを確実にするため、追加でクロック サイクルを適用する必要があります。

スタートアップは、シーケンシャル 7 ステート マシンで制御されています。DONE が High になってから必要なクロック サイクル数は、多めに見積もった場合は 24 です。これは、DONE に理想的なクロックが使用され、デフォルト オプションが使用されているほとんどの場合に適用できます。

BitGen オプションには、スタートアップ シーケンスにレイテンシを追加するものもあります。

このプラットフォームには、次のものが含まれています。

  • LCK_cycle - すべての DCM/MMCM がロックされるまでスタートアップを遅らせます。追加されるクロック サイクル数は未定義です。
  • Match_cycle - DCI が一致するまでスタートアップを遅らせます。追加されるクロック サイクル数は未定義です。
  • DONE_PIPE - DONE_CYCLE に割り当てられているステートにクロック サイクルを追加します。

スタートアップに完全にクロックを供給しないと、次の状況が発生することがあります。

  • I/O がトライステートのままになります。
  • デュアル モード ピンが指定した I/O 規格ではなく LVCMOS で動作します。デュアル モード ピンで DCI を使用する場合、DCI は選択した I/O ではなく、LVCMOS 用にキャリブレーションされます。(Xilinx Answer 14887) を参照すると、この状況を回避できます。
  • コンフィギュレーション ロジックがロックされるため、FPGA デバイスから ICAP インターフェイスにアクセスできません。
  • 一部のデュアル ポート ピン以外ではデューティ サイクルまたは振幅の歪みが出ます。 これは、DIFF_SSTL_15 や LVDS などのような擬似差動信号で発生することがあります。

デバイスがスタートアップ ステート マシンの終わりに達していない場合この状態が発生します。スタートアップ ステートの終わりに達する前はデバイスは完全に動作状態である可能性があります。このため、ICAP の読み出しおよび書き込みにエラーが発生したり、デュアル モード ピンが正しい I/O 規格で動作しなくなることがあります。

このイベントは EOS 信号が High に駆動されていることで確認できます。この状態は STAT レジスタで見られるか、または STARTUP プリミティブを使用した FPGA デバイスで検出されます。

ICAP にアクセスするデザインの場合、 STARTUP プリミティブをインスタンシエートしておくとよいでしょう。

このプリミティブには EOS ピンがあり、これはコンフィギュレーション プロセスが完了し、ICAP が読み出しおよび書き込みアクセスできるようになった状態を示します。

ただし JTAG コンフィギュレーションが使用されている場合は例外です。JTAG の場合、コンフィギュレーション ロジックへのアクセスが最優先されます。

JTAG がコンフィギュレーション ロジックにアクセスしている場合、ICAP の読み出しおよび書き込みにエラーが発生します。この EOS ピンの値は JTAG がアクセスしていることは示しません。

AR# 42128
日付 10/27/2015
ステータス アクティブ
種類 一般
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