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AR# 46136

IBERTデザイン アシスタント - IBERT を使用するときの PLL ロックに関する問題のデバッグ

説明

ChipScope IBERT を使用する場合の PLL ロックに関する問題のデバッグについて説明します。

注記 : このアンサーは、ザイリンクス ChipScope ソリューション センター (ザイリンクス アンサー 45310) の一部です。ザイリンクス ChipScope ソリューション センターは、ChipScope ツールへのあらゆる質問に対応しています。ChipScope ツールを使用して新しいデザインを作成する場合や、問題をトラブルシュートする場合は、ChipScope ソリューション センターで必要な情報を検索してください。

ソリューション


PLL がロックしない IBERT デザインをデバッグするときには次の手順に従ってください。

1) IBERT デザインでボードが正しく設定されていることを確認します。

非常に基本的なことですが、この時点でミスがないことを確認することは大切です。IBERT ウィザードを実行して、ボード コンフィギュレーションが正しく設定されていることを再度確認するとよいでしょう。具体的には、次の点を確認する必要があります。
  • システム クロックのピン ロケーションおよび I/O 規格がボードのものと一致していること
  • ライン レートが正しい速度に設定されていること
  • 基準クロックの設定がボードで使用されているものと一致していること
  • 物理的なトランシーバー コンフィギュレーションがボードで使用されているものと一致していること

2) トランシーバーの PLL がロックされていることを確認します。

Analyzer の IBERT GUI にフィールドがあるので、このフィールドを確認すれば簡単です。PLL がロックされていない場合、オシロスコープのある基準クロックを確認し、そのクロックが正しい周波数でオシレートしていること、シグナル インテグリティが良好であることを確認します。

3) 正しい周波数でシステム クロックがオシレートしていること、シグナル インテグリティが良好であることを確認します。

IBERT デザインで別のシステム クロックが使用されていない場合 (つまり MGT からのクロックが代わりに使用されている場合)、この手順は省くことができます。システム クロックに問題がある場合は Analyzer の IBERT GUI にエラーが表示されますが、システム クロックに問題がないことを確認しておくのがよいでしょう。

4) PLL がトランシーバーに対して正しく設定されていることを確認します。

この手順に関しては、(ザイリンクス アンサー 46936) にある高度な IBERT デバッグ テクニックを参照してください。

5) トランシーバーをリセットします。

IBERT コアへのクロックが供給されていて安定していることが確認できたので、GT をリセットする必要があります。リセットをしても GT はリンク アップされない場合、ループバック モードを近端 PCS または PMA に変更してから、もう一度リセットを試みてください。

6)ザイリンクス開発ボードがある場合は、同じ IBERT コンフィギュレーションをザイリンクス開発ボードで実行してみます。

この作業で、問題がボードに関連したものなのか、IBERT デザインに関連したものなのかが分かります。IBERT がザイリンクス開発ボードで機能する場合、ボードに関連した問題があって、IBERT が機能しなくなっている可能性があります。IBERT がザイリンクス開発ボードで機能しない場合は、ウェブケースを開いてザイリンクス テクニカル サポートまでご連絡ください。ウェブケースはこちらから開くことができます。

http://japan.xilinx.com/support/clearexpress/websupport.htm

アンサー レコード リファレンス

マスター アンサー レコード

Answer Number アンサータイトル 問題の発生したバージョン 修正バージョン
45310 ザイリンクス ChipScope ソリューション センター N/A N/A

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AR# 46136
日付 02/14/2013
ステータス アクティブ
種類 一般
デバイス 詳細 概略
ツール 詳細 概略