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AR# 47606

Virtex-7 FPGA Gen3 Integrated Block for PCI Express v1.1 (ISE 14.1 / Vivado 2012.1) - IES シリコンでの ECRC サポート

説明


問題のあったバージョン : v1.1
修正されたバージョンおよび既知の問題(ザイリンクス アンサー 47441) を参照してください。

Virtex-7 FPGA Integrated Block For PCI Express v1.1 コアは、IES シリコンで ECRC をサポートしていません。

ソリューション


IES シリコンをターゲットにしている場合、End-to-End CRC (ECRC) 機能をファンクションごとにはイネーブルすることができません。ECRC はイネーブルになっているファンクションすべてに対し、イネーブルにするかまたはディスエーブルにする必要があります。この制限は IES シリコンをターゲットにしている場合に適用されます。この問題は既知の問題であり、今後のコアのリリースで修正される予定です。

注記 : [バージョン] 列は、問題が最初に発生したバージョンがリストされます。問題はそれより以前のバージョンでも発生していた可能性がありますが、古いバージョンではそれを検証するテストは実行されていませんでした。

改訂履歴
2012/05/08 - 初版

アンサー レコード リファレンス

マスター アンサー レコード

AR# 47606
日付 05/20/2012
ステータス アクティブ
種類 既知の問題
IP
  • Virtex-7 FPGA Gen3 Integrated Block for PCI Express (PCIe)
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