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AR# 50826

Zynq-7000 サンプル デザイン - ブロック RAM から OCM へのキャッシュ コヒーレントの CDMA 転送

説明

このサンプル デザインでは、M_AXI_GP0 を介して CPU に接続される 4K のブロック RAM が割り当てられています。同じブロック RAM には CDMA からもアクセス可能です。 

CPU によりブロック RAM は初期化されます。単純モードの CDMA はブロック RAM から OCM へ、ACP ポートを介してデータを転送します。転送はキャッシュ コヒーレントで、転送完了時にキャッシュを無効にしたり、消去することなく OCM がアップデートされていることが CPU で確認できます。

注記 : サンプル デザインはアンサーに添付されており、またアンサーの本文には Zynq-7000 で特定の機能をテストするための技術情報が記載されています。コードの抜粋、スナップショット、図、またはザイリンクス ツールの特定バージョンでインプリメントされたデザインなどが含まれています。これらのヒントを今後のザイリンクス ツール リリースにアップデートして、サンプル デザインを必要に応じて修正することも可能です。これらのサンプル デザインに対するサポートには制限があります。

ソリューション

次の表を参照してください。

 

 

 

 

 

 

 

 

インプリメンテーションの詳細
デザイン タイプ PS および PL
ソフトウェア タイプ スタンドアロン
CPU シングル CPU @ 667MHz
PS 機能 MMU、OCM
PL コア BRAM、CDMA
ボード/ツール ZC702
ザイリンクス ツール バージョン Vivado 2015.1
その他の詳細 FCLK @ 50MHz
アドレス マップ





提供されているファイル
cdma_acp_design.zip
 アーカイブされた Vivado プロジェクト.
hello_axi_cdma.c コードの抜粋
 ブロック図
 
 cdma_acp_1.JPG



 

詳細手順

  1. アーカイブされた Vivado デザインを抽出して開いて、ビットストリームを生成し、ビットストリームを含めてハードウェアをエクスポートし、SDK を起動します。
  2. SDK で Empty Application サンプルを作成します。
  3. 含められている C コードの抜粋をインポートします。
  4. XPS で生成されたビットストリームを使用して PL をプログラムします。
  5. アプリケーションを実行します。

注意事項

  1. HIGH OCM は ACP ポートからアクセスできるようにする必要があります。

    MHS で processing_system7 のパラメーターが C_S_AXI_ACP_ENABLE_HIGHOCM = 1 となっていることを確認してください。
  2. MMU 表には共有可能な HIGH OCM があります。

          /* S=b1 TEX=b100 AP=b11, Domain=b0, C=b1, B=b1 */
          Xil_SetTlbAttributes(0xFFF00000,0x10C06);

結果

ターミナルで、テストの終わりに、デスティネーション メモリがソース メモリと一致している必要があります。

特別なソフトウェアがインプリメントされていない状態で CDMA によりデータが転送されていることが CPU で確認されます。

添付ファイル

関連添付ファイル

タイトル サイズ ファイルタイプ
hello_axi_cdma.c 4 KB C
cdma_acp_design_2015_1.xpr.zip 376 KB ZIP

アンサー レコード リファレンス

マスター アンサー レコード

Answer Number アンサータイトル 問題の発生したバージョン 修正バージョン
51779 Zynq-7000 AP SoC - サンプル デザインおよびテクニカル ヒント N/A N/A

関連アンサー レコード

Answer Number アンサータイトル 問題の発生したバージョン 修正バージョン
60821 Vivado 2014.2 - Zynq-7000 サンプル デザイン - ブロック RAM から OCM へのキャッシュ コヒーレントの CDMA 転送 N/A N/A
AR# 50826
日付 12/23/2015
ステータス アクティブ
種類 一般
デバイス
  • Zynq-7000
ツール
  • Vivado Design Suite - 2015.1
IP
  • AXI Central DMA Controller
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