説明

問題の発生したバージョン : v1.04a
修正されたバージョンおよびその他の既知の問題 : (ザイリンクス アンサー 44969) を参照

KC705 Rev C ボード用に AXI Bridge for PCI Express を使用した BSB デザインを生成しても、このコアが検出されません。 

CORE Generator ツールで生成したスタンドアロンのコアは問題なく機能します。

ソリューション

この問題は既知の問題であり、今後のリリースで修正される予定です。

この問題を回避するには、次の手順に従ってください。

1. MHS ファイルの AXI Bridge for PCI Express コア インスタンシエーションに次のものを追加します。
    
   parameter C_PCIE_USE_MODE = 3.0
    
   
2. 生成した UCF ファイルで次の制約をコメント アウトします。
   
   NET "*pcie_7x*/*gt_top_i/pipe_wrapper_i/pipe_lane[0].pipe_rate_i/*" TIG;
   NET "*pcie_7x*/*gt_top_i/pipe_wrapper_i/pipe_lane[1].pipe_rate_i/*" TIG;
   NET "*pcie_7x*/*gt_top_i/pipe_wrapper_i/pipe_reset_i/cpllreset" TIG;

アンサー レコード リファレンス

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