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AR# 51885

14.2 - Zynq - DDR2 駆動電流およびスルー レート レジスタ

説明

テクニカル リファレンスには次の信号が記述されています。

DDRIOB_DRIVE_SLEW_ADDR
DDRIOB_DRIVE_SLEW_DATA
DDRIOB_DRIVE_SLEW_IFF
DDRIOB_DRIVE_SLEW_CLOCK

これらの信号を変更すると、どういう結果になりますか。

ソリューション

これらのレジスタの値の変更は I/O にどう影響するかわからず、JEDEC 規格と互換性がなくなってしまう可能性があり、IBIS モデルが正確ではなくなり、信頼性に問題が出る可能性があります。このため、これらのレジスタのエンコードについては記述されていません。

テクニカル リファレンス マニュアルには、これらのレジスタは EDK での設定から変更しないように今後記述されます。
AR# 51885
作成日 11/26/2012
最終更新日 01/30/2013
ステータス アクティブ
タイプ 一般
IP
  • Memory Interface and Controller
Boards & Kits
  • Zynq-7000 All Programmable SoC Boards and Kits