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AR# 53776

ザイリンクスの Integrated PCI Express Block および Serial RapidIO コアの Verilog シミュレーションの簡単なテスト ケースの作成

説明

このアンサーには、ザイリンクスの Integrated PCI Express Block および Serial RapidIO コアの Verilog シミュレーションの簡単なテスト ケースを作成するための方法を説明する PDF 資料が添付されています。アンサーはウェブ ベースであり、情報は随時更新されます。PDF の最新版を入手するには、このアンサーを参照してください。

ソリューション

このアンサーは、コア インターフェイスにあるデータ パターンを送信するシミュレーションでのテスト ケースを作成するためのテクニックについて主に説明します。PCI Express や Serial Rapid IO などの IP を使用したシステムを設計するとき、入力パケットの問題や、信号が間違ってトグルすることが原因で、システムが停止するような問題が発生することがあります。ハードウェアでこうした問題をデバッグするのは難しく、また時間もかかります。ChipScope などのデバッグ ツールが必要になるからです。特定のテストベンチを記述してシミュレーションでこの問題を再現するのがベストな方法です。しかしこれには問題があって、特定の使用ケース シナリオを再現するためテストベンチで包括的なコードを書かなければなりません。これには時間がかかり、時間との戦いとなるようなプロジェクトの中ではそのようなコードを書いている時間はない場合もあります。

このアンサーに添付されている PDF 資料は、PCI Express および Serial RapidIO コアを使用したデザインのインターフェイスで Verilog の force コマンドを使用してカスタム パケットを駆動する方法について説明しています。 これは強力な Verilog コマンドで、シミュレーションの任意のタイムスタンプで信号を駆動するためにし使用できます。

添付ファイル

関連添付ファイル

タイトル サイズ ファイルタイプ
Xilinx_Answer_53776_verilog_simulation_testbench_ver17.pdf 1 MB PDF
AR# 53776
日付 06/25/2013
ステータス アクティブ
種類 一般
IP
  • 7 Series Integrated Block for PCI Express (PCIe)
  • Serial RapidIO
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