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AR# 54252

LogiCORE IP 10G Ethernet MAC - Vivado 2013.1 およびそれ以降のバージョンのリリース ノートおよび既知の問題

説明

このアンサーでは、10-Gigabit Ethernet MAC コアのリリース ノートおよび既知の問題を示します。次の情報が記載されています。

  • 一般情報
  • 既知の問題および修正された問題
  • 改訂履歴

このリリース ノートおよび既知の問題は、Vivado 2013.1 およびそれ以降のツール バージョンで生成されたコアを対象としています。

以前のバージョンの既知の問題および ISE サポート情報は、『IP リリース ノート ガイド』 (XTP025) を参照してください。

LogiCORE 10-Gigabit Ethernet MAC コア IP ページ :

http://japan.xilinx.com/content/xilinx/ja/products/intellectual-property/do-di-10gemac.html

ソリューション

一般情報

サポートされるデバイスは、次の 3 つの場所から確認できます。

各バージョンにおける新機能と追加されたデバイス サポートのリストは、Vivado デザイン ツールに含まれるコアの変更ログ ファイルを参照してください。

バージョン対照表

次の表に、コアの各バージョンに対して、それが最初に含まれた Vivado デザイン ツールのバージョンを示します。

コアのバージョンVivado のバージョン
v15.1 (Rev. 2)2016.3
v15.1 (Rev. 1)2016.2
v15.12016.1
v15.0 (Rev. 3)2015.4
v15.0 (Rev. 2)2015.3
v15.0 (Rev. 1)2015.2
v15.02015.1
v14.0 (Rev.1)2014.4
v14.02014.3
v13.1 (Rev. 1)
2014.2
v13.12014.1
v13.0 (Rev. 1)2013.4
v13.02013.3
v12.0 (Rev. 1)2013.2
v12.02013.1
v11.52012.4
v11.42012.2


一般的なガイダンス

次の表に、LogiCORE 10-Gigabit Ethernet MAC コアを使用する際の一般的なガイダンスを含むアンサーを示します。

アンサータイトル
(Xilinx Answer 38279)イーサネット IP ソリューション センター
(Xilinx Answer 55077)Ethernet IP - Vivado ツールのデザイン階層


既知の問題および修正された問題

次の表に、Vivado 2013.1 でリリースされた 10-Gigabit Ethernet MAC コア v12.0 以降の既知の問題を示します。

注記 : [問題の発生したバージョン] 列には、問題が最初に見つかったバージョンを示しています。

問題はそれ以前のバージョンでも発生していた可能性がありますが、以前のバージョンではそれを検証するテストは実行されていません。

アンサータイトル問題の発生したバージョン修正バージョン
なし めったに発生しない RX 問題を修正 - フレーム開始直後にケーブル プル イベントがあると AXI-S tvalid がディアサートされないことがあるv15.1(rev.1)v15.1(rev.2)
なし サンプル デザイン RX FIFO 64 ビットの問題を修正 - 最後のワードが FIFO から読み出された直後に fifo_tready がディアサートされると、読み込みが停止するv15.1(rev.1)v15.1(rev.2)
なし RX Statistics 問題を修正 - パディングされた VLAN および通常フレームの Statistics ベクター ビット 29 が間違ってアサートされてしまうv15.1(rev.1)v15.1(rev.2)
(Xilinx Answer 66822)AXI 10G Ethernet Subsystem - ハードウェアおよびシミュレーションでサンプル デザインのフレーム エラーが発生するv15.0 (Rev. 3)v15.1
なしコーナー ケースの RX の問題 - フレームのコンポジションが特定のパターンに一致すると、CRC が間違っているフレームがドロップされないv15.0 (Rev. 2)v15.1
なしコーナー ケースの TX の問題 - 暗示的なエラーおよびフレーム オーバーサイズ エラーが同時に発生するとエラー コードが送信されないv15.0 (Rev. 2)v15.1
なしフレームがドロップされる原因となっていた 64 ビット サンプル デザイン FIFO のバグを修正v15.0 (Rev. 1)v15.1
なしRX の問題を修正 - 長さを示す L/T フィールドが実際のパケットの長さに一致しないとフレームがドロップされないv15.0 (Rev. 1)15.1
なしRX 統計の問題を修正 - 長さを示す L/T フィールドが間違っているフレームに対して RX 統計ビット 29 がアサートされないV15.0v15.1
なしDIC を使用する際の明示的なアンダーランにより続くフレームが破損してしまうことがある v14.0v15.0
(Xilinx Answer 63106)64 ビット マスターを使用すると AXI4-Lite インターフェイスでエラーが発生するv14.0v15.0
(Xilinx Answer 63212)受信 AXI-stream FIFO で動作が停止する問題 v14.0v15.0
(Xilinx Answer 63439) TX FIFO サンプル デザインはインバンド FCS とカスタム プリアンブルがディスエーブルになっている場合にのみ全スループットで動作v14.0v15.0
なしコーナー ケース - ジャンボ フレームおよび MTU はディスエーブル、VLAN はイネーブル、インバンド FCS はイネーブルになっている TX コンフィギュレーションで、1524 バイトのオーバーサイズの VLAN フレームが間違って、XGMII エラー コードなしに送信される可能性があるv13.0v14.0
なしFIFO メモリ サイズよりも大きなサイズのフレームが送信されると、サンプル デザインの送信 FIFO が停止することがあるv13.0v14.0
(Xilinx Answer 59891)MDIO 信号入力に XDC 制約を追加することでタイミング クロージャが容易になる v13.0v13.1
(Xilinx Answer 59308)RX 統計カウンターでフラグメント フレームがサイズ不十分フレームとしてカウントされる v13.0v13.1
(Xilinx Answer 60197)TX 統計におけるオーバーサイズ フレーム カウントの修正 v13.0v13.1
なしコーナー ケース - RX 統計 - ラント フレームが受信されたときに RX 統計ベクター ビット 29 がアサートされないことがあるv13.0v13.1
なしコーナー ケース - 送信フレーム - ラント フレームの後の TX フレームに不正なスタート コードおよび IFG が含まれることがある
v13.0v13.1
なしコーナー ケース - カスタム プリアンブル - リセット後に最初に送信されるフレームに前のカスタム プリアンブルが含まれることがある (リセット前にカスタム プリアンブルがイネーブルになり、リセット後にディスエーブルになった場合)
v13.0v13.1
(Xilinx Answer 55131)Artix-7 デバイスをターゲットにすると WAN モードで少しの差でタイミングが満たされないv12.0アンサーの回避策を参照
(Xilinx Answer 55038)サンプル デザインで内部 XGMII インターフェイスの tx_dcm_locked ポートが駆動されないv12.0v12.0 (Rev. 1)
なし範囲外フレームが受信された直後に別のフレームが続くと、範囲外フレームが統計でカウントされないv11.5v12.0
なし12 バイト アンダーサイズ フレームを受信しても良好フレームと認識されるv11.5v12.0
なしインバンド FCS パッシングの 63 バイト フレームを送信するとトランスミッターが停止するv11.5v12.0
なしパワーアップ後最初に送信されるフレームに間違った FCS が含まれることがあるv11.5v12.0
なし10GEMAC でフレーム エラー後 TX で IFG の最小値が強制されないv11.5v12.0



アンサー レコード リファレンス

サブアンサー レコード

関連アンサー レコード

AR# 54252
作成日 02/13/2013
最終更新日 10/13/2016
ステータス アクティブ
タイプ リリース ノート
ツール
  • Vivado Design Suite - 2013.1
IP
  • 10 Gigabit Ethernet Media Access Controller