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AR# 54666

LogiCORE IP XAUI - Vivado 2013.1 およびそれ以降のツール バージョンのリリース ノートおよび既知の問題

説明

このアンサーは、 XAUI コアのリリース ノートおよび既知の問題で、次の情報が記載されています。

  • 一般情報
  • 既知の問題および修正された問題
  • 改訂履歴

このリリース ノートおよび既知の問題は、Vivado 2013.1 およびそれ以降のツール バージョンで生成されたコアを対象としています。
以前のバージョンの既知の問題および ISE サポート情報は、『IP リリース ノート ガイド』 (XTP025) を参照してください。

LogiCORE XAUI Core IP ページ :

http://japan.xilinx.com/products/ipcenter/XAUI.htm

ソリューション

一般情報

サポートされるデバイスは、次の 3 つの場所から確認できます。

各バージョンにおける新機能と追加されたデバイス サポートのリストは、Vivado デザイン ツールに含まれるコアの変更ログ ファイルを参照してください。

バージョン対照表

次の表に、コアの各バージョンに対して、それが最初に含まれた Vivado デザイン ツールのバージョンを示します。

コアのバージョンVivado のバージョン
v12.2 (Rev. 6)2016.3
v12.2 (Rev. 5)2016.2
v12.2(Rev.4)2016.1
v12.2(Rev.3)2015.4
v12.2 (Rev. 2)2015.3
v12.2 (Rev. 1)2015.2
v12.22015.1
v12.1 (Rev. 4)
2014.4
v12.1 (Rev. 3)
2014.3
v12.1(Rev. 2)2014.2
v12.1 (Rev. 1)
2014.1
v12.12013.4
v12.02013.3
v11.0 (Rev. 1)2013.2
v11.02013.1
v10.42012.2
v10.32012.1


一般的なガイダンス

次の表に、LogiCORE XAUI コアを使用する際の一般的なガイダンスを含むアンサーを示します。

アンサータイトル
(Xilinx Answer 38279)イーサネット IP ソリューション センター
(Xilinx Answer 33596)XAUI に関してよく寄せられる質問 (FAQ)
(Xilinx Answer 55077)Ethernet IP - Vivado ツールのデザイン階層


既知の問題および修正された問題

次の表に、Vivado 2013.1 でリリースされた XAUI コア v11.0 以降の既知の問題を示します。

注記 : [問題の発生したバージョン] 列には、問題が最初に見つかったバージョンを示しています。

問題はそれ以前のバージョンでも発生していた可能性がありますが、以前のバージョンではそれを検証するテストは実行されていません。

アンサータイトル問題の発生したバージョン修正バージョン
(Xilinx Answer 66941)DXAUI コアのサンプル デザインのシミュレーションでエラーが発生するv12.2 (Rev. 2)v12.2(Rev.3)
UltraScale - GT Near-end PMA ループバックへの入力および出力後に GTRXRESET が必要v12.0v12.2
(Xilinx Answer 62354)トランシーバーを使用して PRBS 入力をデバッグすると、GTRXRESET がトグルする v12.0v12.2
(Xilinx Answer 62351)GTP および GTH - Unifast モデルまたは SIM_GTRESET_SPEEDUP を使用している場合のシミュレーションはサポートされていないv10.4なし
(Xilinx Answer 59912)タイミング クロージャー削除のための MDIO 信号入力への XDC 制約の追加 v12.1v12.1 (Rev. 1)
(Xilinx Answer 59292)TX P位相アライメント ステートマシンがパワーダウンの立ち下がりエッジでリセットされない v12.0
v12.1 (Rev. 1)
(Xilinx Answer 59861)GTP および GTH - プロダクションのリセット DRP シーケンスが回復にリコンフィギュレーションが必要な停止状態になる v12.0v12.1 (Rev. 1)
(Xilinx Answer 59860)7 シリーズ GTP/GTH - reset_in_progress 中の GT へのリセットが停止されるようにアップデート v12.0v12.1 (Rev. 1)
(Xilinx Answer 58083)7 シリーズ GTX トランシーバーの属性 - RXDFEXYDEN のアップデート v10.4v12.0
(Xilinx Answer 56312)7 シリーズ GTP/GTH のリセット ロジックへのアップデート v11.0 (Rev. 1)v12.0
(Xilinx Answer 55132)Artix-7 - 20G DXAUI - タイミングがわずかに満たされない v11.0アンサーに回避策
(Xilinx Answer 55837)7 シリーズ GTP および GTH の RX 終端のアップデートv11.0v11.0 (Rev. 1)
(Xilinx Answer 55226)フォルス パス制約の DRP パスに一致するセルがないというクリティカル警告が発生する v11.0v11.0 (Rev. 1)
(Xilinx Answer 55009)7 シリーズ GTX/GTH/GTP トランーバーのデザイン アドバイザリ - バッファー バイパス モードでの位相アライメントの TX 同期化コントローラーの変更 v10.4v11.0
(Xilinx Answer 53779)Virtex-7 FPGA GTH トランシーバーのデザイン アドバイザリ - 製品版シリコンの RX リセット シーケンス要件 v10.4v11.0
(Xilinx Answer 53561)Artix-7 FPGA GTP トランシーバーのデザイン アドバイザリ : 製品版シリコンの RX リセット シーケンス要件v10.4v11.0
(Xilinx Answer 50848)7 シリーズ GT トランシーバー - ルーバックを無効にするとリセットが必要になることがあるv10.3v11.0
(Xilinx Answer 50795)7 シリーズ - XAUI サンプル デザインでのタイミング エラーv10.4v11.0


アンサー レコード リファレンス

サブアンサー レコード

Answer Number アンサータイトル 問題の発生したバージョン 修正バージョン
55226 LogiCORE XAUI v11.0 - Vivado - フォルス パス制約の DRP パスに一致するセルがないというクリティカル警告が発生する N/A N/A
55132 LogiCORE XAUI v11.0 - Vivado - Artix-7 - 20G DXAUI - 限界タイミング エラー N/A N/A
55077 Ethernet IP - Vivado ツールのデザイン階層 N/A N/A
58083 RXAUI v3.0 および XAUI v11.0 以前のバージョン - 7 シリーズ GTX トランシーバーの属性 RXDFEXYDEN のアップデート N/A N/A
59860 XAUI v12.0 および RXAUI v4.0、Vivado 2013.4 およびそれ以前 - reset_in_progress 中に GT への追加リセットを回避するためのアップデート N/A N/A
59861 XAUI および RXAUI - Vivado 2013.4 以前 - GTP および GTH - プロダクション リセット DRP シーケンスが停止し、リコンフィギュレーションが必要になる N/A N/A
59292 XAUI/RXAUI Vivado 2013.4 およびそれ以前のバージョン - TX 位相アライメント ステートマシンがパワーダウンの立ち下がりエッジでリセットされない N/A N/A
59912 XAUI v12.1 - MDIO 信号入力に XDC 制約を追加するとタイミング クロージャが容易になる N/A N/A
62351 XAUI および RXAUI - GTP および GTH - DRP プロダクション リセット シーケンスを使用する場合、Unifast モデルまたは SIM_GTRESET_SPEEDUP を使用するシミュレーションはサポートされていない N/A N/A

関連アンサー レコード

AR# 54666
作成日 02/28/2013
最終更新日 10/13/2016
ステータス アクティブ
タイプ リリース ノート
ツール
  • Vivado Design Suite - 2013.1
IP
  • XAUI