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AR# 54673

MIG 7 Series DDR3 - デバッグ信号が有効になっていると ChipScope Write ILA のライト レベリング デバッグ信号が正しく接続されない


問題の発生したバージョン : MIG 7 Series 1.8
修正バージョン : (ザイリンクス アンサー 45195) を参照

デバッグ信号を有効にして MIG 7 Series DDR3 デザインを生成すると、ライト レベリング キャリブレーションのデバッグ信号の一部が Write ILA ChipScope コアに正しく接続されません。 


  • wl_po_coarse_cnt,
  • wl_po_fine_cnt, 
  • rd_data_edge_detect_r,
  • wl_edge_detect_valid_r. 

このアンサーでは、今後の MIG 7 Series で問題が修正されるまで、これらの ILA 接続を手動で修正する方法を示します。


user_design/rtl/core_name.v モジュールでは、デバッグ信号が ChipScope ILA コアへ接続されています。

このモジュールを開いて「ILA for monitoring write path signals」セクションの位置を特定します。


   //     - ILA for monitoring write path signals,
   //       and synchronized read data
   assign rd_data_edge_detect_r  = dbg_phy_wrlvl[67+:9]; //66
   assign wl_po_fine_cnt         = dbg_phy_wrlvl[76+:54]; //75
   assign wl_po_coarse_cnt       = dbg_phy_wrlvl[130+:27];  //129
   assign ddr3_ila_wrpath[10]    = dbg_phy_wrlvl[60]; //59  // wl_edge_detect_valid_r
   assign ddr3_ila_wrpath[96+:54] = dbg_phy_wrlvl[76+:54];  //75
   assign ddr3_ila_wrpath[150+:27]= dbg_phy_wrlvl[130+:27]; //129

アンサー レコード リファレンス

マスター アンサー レコード

Answer Number アンサータイトル 問題の発生したバージョン 修正バージョン
67815 「[Synth 8-4169] error in use clause: package 'vcomponents' not found in library 'xpm'」というエラー メッセージが表示される N/A N/A
67818 Zynq UltraScale+ MPSoC: JTAG/SD ブート モードでの 2016.3 PMUFW の読み込みおよびサンプルの実行 N/A N/A
67819 Zynq UltraScale+ MPSoC: 2016.3 PMUFW、カスタム初期化コードの追加方法 N/A N/A
67449 High Speed SelectIO Wizard - 同じセットアップのインスタンスを複数作成する方法 N/A N/A
67442 JESD204B - 確実に繰り返し可能なレイテンシを実現するためのシンプルなアプローチ N/A N/A
67440 AXI Bridge for PCI Express Gen3 (Vivado 2016.1) - 「[IP_Flow 19-3505] IP Generation error: Failed to generate IP 'axi_pcie3_0'. Failed to generate 'Examples' outputs:」というエラー メッセージが表示される N/A N/A
674 SPROMS マーク : XC1700 注文番号 (パーツ番号) と PROM 識別番号が同じパーツで異なる N/A N/A
67544 DDR4/DDR3 UltraScale IP - Normal Ordering Error モードの使用時にユーザー インターフェイスでデータ エラーが検出される。現れたエラー データは同じアドレスから後に読み出される正常なデータである。app_rdy は Low のままになることがある。 N/A N/A
67543 Vivado System Generator v2016.2 - Ubuntu 14.04 で System Generator スクリプトを実行しても Matlab が起動しない N/A N/A
67548 ECO : Next Generation FPGA Editor N/A N/A
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67044 JESD204 PHY v2.0, v3.0, v3.1 (2015.1, 2015.2, 2015.3, 2015.4, 2016.1) - TXDIFFCTRL low default value N/A N/A
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67142 2016.1 - Simulation - Project Utilities Tcl App update required for Export Simulation N/A N/A
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6738 HP 1.5i Install : 1 archive had fatal errors. file #0. bad zipfile offset (lseek): 0 N/A N/A
67384 Vivado - 「[Place 30-678] Failed to do clock region partitioning」というエラー メッセージが表示される。 N/A N/A
67382 Vivado シミュレーション - Linux 64 ビット OS で ModelSim DE をターゲットにした compile_simlib を使用するとエラーが発生する N/A N/A
67381 2016.1 Vivado Hardware Manager : 一部の UltraScale デバイスに対して間違った IDCODES が Vivado Hardware Manager GUI で表示される N/A N/A
6789 1.5i SpartanXL PAR - Divide by Zero crash N/A N/A
67897 Modular Media over IP RFC4175 De-Packetizer - Release Notes and Known Issues for the Vivado 2013.1 tool and later versions N/A N/A
67895 2016.4 Vivado IP Flows - MicroBlaze ブロックを含むブロック デザイン (BD) をパッケージするときに「CRITICAL WARNING: [IP_Flow 19-4791] Block design with Microblaze subdesign IP 'my_design_microblaze_0_0' should be packaged with the XCI option」というクリティカル警告メッセージが表示される N/A N/A
67892 QuestaSim - 「Fatal: (vsim-12005) Undefined function '_ZN5boost6system15system_categoryEv' introduced from '/Xilinx/VIVADO/Vivado/2016.1/lib/lnx64.o/librdi_commonxillic.so' is being called」という致命的なエラー メッセージが表示される N/A N/A
67893 2016.2 ダウンロード - Windows 10 で Vivado をダウンロードしようとするとブラウザーに「The signature of Xilinx_Vivado_SDK_2016.2_0605_1_Win64.exe is corrupt or invalid」というメッセージが表示される N/A N/A
67898 Modular Media over IP RFC3190 De-Packetizer - Release Notes and Known Issues for the Vivado 2013.1 tool and later versions N/A N/A
67890 2016.3 - Vivado シミュレータ - プリコンパイルされた IP インスタンスのスコープが [Scope] ウィンドウに表示されない N/A N/A
67899 Modular Media over IP RFC4175 Packetizer - Release Notes and Known Issues for the Vivado 2013.1 tool and later versions N/A N/A
67891 DDR4/DDR3 IP - BFM シミュレーション モードを使用したピンポン PHY ビヘイビアー シミュレーションでデータ エラーによる問題が発生する N/A N/A
67896 MIPI CSI-2 Transmitter Subsystem - Release Notes and Known Issues for the Vivado 2013.1 tool and later versions N/A N/A
6752 *Obselete* 1.5i JTAG Programmer - SP2 Patch update-9500XL/Win95 error when programming (Error:basut - Check the target power supply is stable...) N/A N/A
67522 SDDebug および SDRelease ビルドの設定を別々に指定可能 N/A N/A
67523 SDSoC - パフォーマンス見積もりを使用してコマンド ライン引数を実行ファイルへ含める方法 N/A N/A
67520 MIG 7 Series DDR3 - 連続する書き込みトランザクション中に VT トラッキングに使用される周期読み出しが欠落することがある N/A N/A
67528 10G/25G Ethernet Subsystem シミュレーション時間の短縮方法 N/A N/A
67521 SDSoC - SDSoC 2016.2 - リリース ノートおよび既知の問題 N/A N/A
6782 NGDBUILD netlist priority: What's the searching order NGDBUILD uses to merge hierarchical modules into a .ngd file N/A N/A
67820 Zynq UltraScale+ MPSoC: 2016.3 PMUFW、エラー管理 N/A N/A
67828 Zynq UltraScale+ MPSoC: Linux SPI の割り込みマップ N/A N/A
67824 2016.2 Virtex UltraScale+ - クロック配線との PS8 ブロック干渉が適切に考慮されていないためクロック配置プログラムで UltraScale+ デザインを分割できない N/A N/A
6749 Virtex コンフィギュレーション - DONE ピンが High にならず、INIT ピンが Low にならない N/A N/A
67499 2016.2 Vivado - Loading a synthesized or implemented design in Vivado gives an Internal Exception and the error message "Xgd File 'xc****.xgd' is missing" N/A N/A
67491 High Speed SelectIO Wizard - SLVS IOSTANDARD を選択できない N/A N/A
671 Error cl192 or cl126 while converting a PALASM (PDS) file N/A N/A
67558 Vivado - 「ERROR: [Project 1-589] Checkpoint part '(part name)-es2' is not available. Closest-matching available part(s): (part name)」というエラー メッセージが表示される N/A N/A
67553 2016.2 - SDSoC - ZC706_mem プラットフォームが正しく動作しない N/A N/A
67551 整数範囲を超えても警告またはエラー メッセージが Vivado シミュレータで表示されない N/A N/A
67651 Zynq UltraScale+ MPSoC, PS DDR - Video Class Traffic Might Underrun When DDR ECC Is Enabled N/A N/A
67796 「ERROR: [VRFC 10-449] cannot open file "/afs/xxxx/obsfdacmj4ltsh34hqceamceyrcimraog5opt0hdnxd.sdb" for writing」というエラー メッセージが表示される N/A N/A
67793 MIPI CSI-2 Receiver Subsystem v2.0 (Rev. 1) - 2 つの CSI-2 Receiver Subsystem を 1 つをマスター、もう 1 つをスレーブとして使用すると、video_aresetn でタイミング エラーが発生する N/A N/A
6701 VERILOG-XL - How do I run simulation with Verilog-XL? N/A N/A
67013 2016.1 - -ise_install_path オプションを使用すると、compile_simlib で複数のエラーが発生してシミュレーションがエラーになる N/A N/A
67010 Vivado HLS 2016.1 : Why does the perfect loop example have poorer performance versus the imperfect loop example? N/A N/A
67015 2016.1 - compile_simlib - プログラムが異常終了する (EXCEPTION_ACCESS_VIOLATION) N/A N/A
67012 2016.x Vivado シミュレータ - 既知の問題 N/A N/A
67420 PetaLinux 2016.2 の場合に QEMU の Zynq UltraScale+ MPSoC ボード で XEN テストが正しく機能しない N/A N/A
67426 SDSoC - カスタム プラットフォームをターゲットしているときにアプリケーションをデバッグできない N/A N/A
67421 DMA Subsystem for PCI Express (Vivado 2016.2) - 64 ビット BAR のプリフェッチ可能設定 N/A N/A
67422 UltraScale FPGA Gen3 Integrated Block for PCI Express (Vivado 2016.2) - 何度かリセットするとリンク アップ エラーになる N/A N/A
67427 Zynq UltraScale - Zynq UltraScale QEMU で実行している Linux アプリケーションのデバッグ方法 N/A N/A
679 Obselete : Could not get model for statbar! N/A N/A
67938 2016.X - シミュレーション - ModelSim で XPM をシミュレーションするとエラーが発生する N/A N/A
67936 Vivado - 「ERROR: [Project 1-202] Error writing the XML file 'Z:/eda/myproj/myproj.xpr'」というエラー メッセージが表示される N/A N/A
67933 UltraScale Memory IP - カスタム パーツを含むメモリ IP が含まれているプロジェクトをアーカイブして移動するとエラー メッセージが表示される N/A N/A
67931 1G/2.5G Ethernet PCS/PMA or SGMII v15.2 - トランシーバーのないデバイスに対して GUI で [SGMII over LVDS] オプションが有効に設定されない N/A N/A
67939 Soft Error Mitigation (SEM) IP – Vivado 2016.3 での makedata.tcl ファイルの位置 N/A N/A
67930 2016.2 PetaLinux Zynq UltraScale+ MPSoC GEM クロック制御は RX の EMIO クロック用に設定する必要がある N/A N/A
6709 FPGA コンフィギュレーション - STARTUP プリミティブを使用する場合に DONE ピンが High にならない N/A N/A
67098 2016.1 UltraScale インプリメンテーション - UltraScale のクロック配線に対する新しい DRC チェックで誤ってエラーがフラグされる場合がある N/A N/A
AR# 54673
日付 08/18/2014
ステータス アクティブ
タイプ 既知の問題
  • Artix-7
  • Kintex-7
  • Virtex-7
  • MIG 7 Series