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AR# 54673

MIG 7 Series DDR3 - デバッグ信号が有効になっていると ChipScope Write ILA のライト レベリング デバッグ信号が正しく接続されない

説明

問題の発生したバージョン : MIG 7 Series 1.8
修正バージョン : (ザイリンクス アンサー 45195) を参照

デバッグ信号を有効にして MIG 7 Series DDR3 デザインを生成すると、ライト レベリング キャリブレーションのデバッグ信号の一部が Write ILA ChipScope コアに正しく接続されません。 

正しく接続されていない信号は次のとおりです。

  • wl_po_coarse_cnt,
  • wl_po_fine_cnt, 
  • rd_data_edge_detect_r,
    and 
  • wl_edge_detect_valid_r. 

このアンサーでは、今後の MIG 7 Series で問題が修正されるまで、これらの ILA 接続を手動で修正する方法を示します。

ソリューション

user_design/rtl/core_name.v モジュールでは、デバッグ信号が ChipScope ILA コアへ接続されています。

このモジュールを開いて「ILA for monitoring write path signals」セクションの位置を特定します。

次のように、接続を更新します。

コメント部分のポート番号が古く、誤った接続です。
 
//*******************************************************
   //     - ILA for monitoring write path signals,
   //       and synchronized read data
   //*******************************************************
 
   assign rd_data_edge_detect_r  = dbg_phy_wrlvl[67+:9]; //66
   assign wl_po_fine_cnt         = dbg_phy_wrlvl[76+:54]; //75
   assign wl_po_coarse_cnt       = dbg_phy_wrlvl[130+:27];  //129
 
   assign ddr3_ila_wrpath[10]    = dbg_phy_wrlvl[60]; //59  // wl_edge_detect_valid_r
   assign ddr3_ila_wrpath[96+:54] = dbg_phy_wrlvl[76+:54];  //75
   assign ddr3_ila_wrpath[150+:27]= dbg_phy_wrlvl[130+:27]; //129
 

アンサー レコード リファレンス

マスター アンサー レコード

Answer Number アンサータイトル 問題の発生したバージョン 修正バージョン
N/A N/A
N/A N/A
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AR# 54673
作成日 03/01/2013
最終更新日 08/18/2014
ステータス アクティブ
タイプ 既知の問題
デバイス
  • Artix-7
  • Kintex-7
  • Virtex-7
IP
  • MIG 7 Series