説明

問題の発生したバージョン: v1.8
修正されたバージョン: (Xilinx Answer 45195) および (Xilinx Answer 54025) を参照

アドレスおよび制御信号に 4 バイトのグループが使用されると、MIG により間違ったベクター サイズが最上位ファイルの ADDR_CTL_MAP に割り当てられます。 

32 ビットが必要な場合は 24 ビットのベクターが使用されます。

ソリューション

ベクター サイズはアドレスおよび制御信号を 3 バイト レーンに拡散させるようにのみ設定されているのですが、4 バイトも指定できてしまいます。

この問題を回避するには、デザインの最上位にあるバイトおよびビット位置と同じになるよう、ADDR_CTL_MAP パラメーターの幅を 32 ビットに増やす必要があります (ADDR_CTL_MAP の詳細は UG586 を参照)。

parameter ADDR_CTL_MAP = 32'h00_00_12_13,

注記: バンク選択ページでは、アドレスおよび制御 I/O はすべて同じバンク内の 2 バイト グループに制限されるため、この影響があるのは [Fixed Pin Out] を使用しているデザインのみです。

改訂履歴
2013/04/03 - 初版