説明

問題の発生したバージョン : v1.9
修正バージョンおよび既知の問題 : (ザイリンクス アンサー 40469) を参照

Artix-7 デバイス用に 7 Series Integrated Block for PCI Express v1.9 コアを ISE 14.5 で生成しインプリメントすると、そのタイミングが満たされない場合があります。

ソリューション

これは既知の問題で、修正の予定はありません。

Vivado Design Suite で Artix-7 FPGA デザインを生成しインプリメントするようにしてください。Vivado ツールでインプリメントするとこのようなタイミングの問題は発生しません。

注記: 「問題の発生したバージョン」は、問題が最初に発見されたバージョンを示します。問題はそれより以前のバージョンでも発生していた可能性がありますが、以前のバージョンではそれを検証するテストは実行されていません。

改訂履歴
2013/05/23 - 初版

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