AR# 64440

UltraScale FPGA GTY トランシーバー - 既知の問題およびアンサー レコード リスト

説明

このアンサーは、 Virtex UltraScale FPGA GTY トランシーバーに関する既知の問題とアンサーをリストしています。

ソリューション

使用法:


(Xilinx Answer 66647)UltraScale GTH および GTYトランシーバー - 負電流により MGTAVTT にバイアス電圧が生じる
(Xilinx Answer 66160)ADS - UltraScale GTY の IBIS-AMI モデルを使用したサンプル デザイン プロジェクト
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(Xilinx Answer 63391)UltraScale GTY のライン レートがデータシートの表 58 の最小値に違反する
(Xilinx Answer 63704)UltraScale GTH/GTY - 非同期ギアボックス モードを使用しているときに内部 PRBS パターン ジェネレーターを使用するよう切り替える方法
(Xilinx Answer 64012)128 ビット デバイス インターフェイス (64 ビットの内部データ幅) の UltraScale GTY の同期ギアボックス モード (CAUI でない) の使用
(Xilinx Answer 61946)Virtex Ultrascale GTY - UG578 v1.0 - ライン レートが 16.375Gbps を超える場合の基準クロック選択の記述が間違っている
(Xilinx Answer 62261)GTY TX 位相インターポレーターの使用におけるデータ レートの制限

ウィザード:

(Xilinx Answer 57487)UltraScale FPGA Transceiver Wizard - Vivado 2013.4 およびそれ以降のバージョン向けのリリース ノートおよび既知の問題
(Xilinx Answer 65228)GTH トランシーバーを使用して COMMON ブロックを共有する方法
(Xilinx Answer 58437)Vivado - UltraScale Transceivers Wizard で「[Route 35-54] unrouted nets」というメッセージが表示される
(Xilinx Answer 62977)UltraScale GTH/GTY SATA COMINIT/COMAWAKE バースト数が設定よりも 1 多くなる
(Xilinx Answer 62548)GTY/GTH の refclk 出力がトグルしない
(Xilinx Answer 62730)2014.3 - IBERT - UltraScale - RESETFSM_OVERRIDE ビットがデフォルトで 1 に設定される

アンサー レコード リファレンス

マスター アンサー レコード

Answer Number アンサータイトル 問題の発生したバージョン 修正バージョン
54480 LogiCORE IP JESD204 - Vivado 2013.1 およびそれ以降のバージョンのリリース ノートおよび既知の問題 N/A N/A
AR# 64440
日付 09/03/2019
ステータス アクティブ
種類 既知の問題
デバイス