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AR# 70941

25G/50G/100G および Flex-O Reed-Solomon Forward Error Correction (RS-FEC) コア - 2018.1 以前のバージョン - Windows で生成すると、サンプル デザインのアライメント マーカーが間違っている

説明

Vivado 2018.1 以前のバージョンを使用し、Windows で 25G、50G、100G または Flex-O RS-FEC コアを生成すると、RS-FEC サンプル デザインの RX および TX のアライメント マーカーが間違っています。

各アライメントマーカーの上位 32 ビットが間違って、core_name_exdes.v ファイルで 0 に設定されています。

たとえば、100G の場合は次のようになっています。

 

    .CTL_RX_VL_MARKER_ID0      (64'h000000003E97DE00),
    .CTL_RX_VL_MARKER_ID1      (64'h00000000628E7100),
     ...
    .CTL_RX_VL_MARKER_ID18     (64'h00000000A099D500),
    .CTL_RX_VL_MARKER_ID19     (64'h000000003F0F1A00),

    .CTL_TX_VL_MARKER_ID0      (64'h000000003E97DE00),
    .CTL_TX_VL_MARKER_ID1      (64'h00000000628E7100),
     ...
    .CTL_TX_VL_MARKER_ID18     (64'h00000000A099D500),
    .CTL_TX_VL_MARKER_ID19     (64'h000000003F0F1A00),

ソリューション

この問題を回避するには、サンプル デザインを Linux で生成するか、または RX および TX アライメント マーカーの値を core_name_exdes.v ファイルで手動でアップデートします。

この問題は、スタンドアロンの RS-FEC コアのサンプル デザインにのみ影響し、RS-FEC コア自体または RS-FEC をサブコアとして使用する 25G/50G/100G Ethernet Subsystems などのコアには影響しません。

この問題は、Vivado 2018.2 で修正される予定です。

AR# 70941
日付 04/16/2018
ステータス アクティブ
種類 一般
IP
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