このアンサーには、Vivado 2018.3 での Soft-Decision FEC (SDFEC) Integrated Block v1.1 (Rev 2) のパッチ アップデートが含まれています。
このパッチは Vivado 2019.1 およびそれ以降のバージョンでは不要になります。
修正された問題:
(Xilinx Answer 71823) | Windows OS でシミュレーションのみのサンプル デザインを使用すると、スティミュラスが正しく生成されない |
(Xilinx Answer 71876) | SD-FEC、LDPC Encoder/Decoder、または Polar Encoder/Decoder C-models を別の DSP IP C-models を組み合わすと実行ファイルがクラッシュする |
インストール方法:
方法 1: (Vivado 2014.4 およびそれ以降のみ)
方法 2:
Soft-Decision FEC (SDFEC) Integrated Block の既知の問題については、(Xilinx Answer 70720) を参照してください。
タイトル | サイズ | ファイルタイプ |
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AR71873_Vivado_2018_3_preliminary_rev2.zip | 8 MB | ZIP |
Answer Number | アンサータイトル | 問題の発生したバージョン | 修正バージョン |
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70720 | Soft-Decision FEC (SDFEC) Integrated Block - Vivado 2018.1 以降のバージョンでのリリース ノートおよび既知の問題 | N/A | N/A |
Answer Number | アンサータイトル | 問題の発生したバージョン | 修正バージョン |
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71823 | Soft-Decision FEC (SDFEC) v1.1 (Rev 1) - Windows OS でシミュレーションのみのサンプル デザインを使用すると、スティミュラスが正しく生成されない | N/A | N/A |
Answer Number | アンサータイトル | 問題の発生したバージョン | 修正バージョン |
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71876 | SDFEC、LDPC Encoder/Decoder、Polar Encoder/Decoder - SD-FEC、LDPC Encoder/Decoder、または Polar Encoder/Decoder の C モデルとその他の DSP IP の C モデルを組み合わせると実行ファイルがクラッシュする | N/A | N/A |
AR# 71873 | |
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日付 | 01/15/2019 |
ステータス | アクティブ |
種類 | 一般 |
IP |