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AR# 43989

7 シリーズ FPGA - HR (High Range) および HP (High Performance) I/O バンクに対する LVDS_33、LVDS_25、LVDS_18、LVDS 入力と出力

説明

7 シリーズ HR (High Range) I/O バンクでは、3.3V での電源供給または LVDS_33 I/O 規格のサポートが可能ですか。

以前の Spartan ファミリで LVDS_33 出力を使用している場合、この差動信号を次のものに接続できますか。

  •  
    • 7 シリーズ HR I/O バンク差動ピン ペア
    • 7 シリーズ HP (High Performance) I/O バンク差動ピン ペア

1.8V で電源供給されない HP I/O バンクでは、LVDS 入力を使用できますか。

2.5V で電源供給されない HR I/O バンクでは、LVDS_25 入力を使用できますか。

ソリューション

3.3V LVDS :

  • 以前の FPGA ファミリの一部で使用できた LVDS_33 I/O 規格は、7 シリーズではサポートされません。
  • HR (High Range) バンクまたは HP (High Performance) バンクで、3.3V の VCCO 電源ピンは使用できません (LVDS 出力を使用する場合)。
  • 7 シリーズ I/O バンクで以前のファミリの LVDS_33 出力をサポートできる場合がありますが、次の条件を満たしていることを確認してください。

    この 2 点に違反が発生しないようにするため、IBIS または HSPICE モデルを用いたシグナル インテグリティのシミュレーションが必要な場合があります。

  1.  
    1. データ シートの表 1 および 2 の VIN に違反が発生していない
    2. LVDS (HP バンク) または LVDS_25 (HR バンク) の VIDIFF および VICM に違反が発生していない

適切な電圧レベルに VCCO が設定されていない場合の LVDS または LVDS_25 入力の使用

VCCO レベルが 1.8V ではない場合でも、LVDS 入力を HP I/O バンクに配置することが可能です。LVDS 出力 (つまり、双方向 LDVS) は、電源電圧が 1.8V のバンクでのみ使用できます。
同様に、VCCO レベルが 2.5V ではない場合でも、LVDS_25 入力を HR I/O バンクに配置することが可能です。  LVDS_25 出力 (つまり、双方向 LVDS_25) は、電源電圧が 2.5V のバンクでのみ使用できます。

ただし、次の点に注意してください。

  1. DIFF_TERM 属性が FALSE でなければなりません。つまり、外部差動終端抵抗を使用する必要があります。
  2. 駆動デバイスの VOD および VOCM レベルが 7 シリーズ レシーバーの VIDIFF および VICM の範囲内であり、データ シートの表 1 および 2 の VIN に違反が発生していないようにする必要があります。

     

『7 シリーズ FPGA SelectIO リソース ユーザーガイド』 (UG471) の表 1-55 には、サポートされる全 I/O 規格に対する VCCO および VREF 電圧レール要件がまとめられています。この表では、入力と出力がそれぞれ異なる列に表示されています (双方向ピンは両方に準拠する必要がある)。

 

LVDS インターフェイス チェックリスト

インターフェイスに LVDS を使用している場合、次のチャートを使用して LVDS の適切な使用要件を満たしているか確認してください。 

hp_checklist.PNG

 

 

hr_checklist.PNG






 

AR# 43989
日付 10/14/2014
ステータス アクティブ
種類 一般
デバイス
  • Artix-7
  • Kintex-7
  • Virtex-7
  • Virtex-7 HT
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