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AR# 47521

Zynq-7000 AP SoC、DDR - DCI Quiet モードはサポートされない

説明

DDR I/O バッファー (DDRIOB) DCI インピーダンス調整モード (slcr.DDRIOB_DCI_CTRL [UPDATE_CONTROL]) は TRM v1.5 またはそれ以降のバージョンの第1 0 章のキャリブレーションの表に従って設定する必要があります。

ソリューション

影響 : 低い
回避策 :なし.
対象となるコンフィギュレーション : PS の DDR を使用するシステム
対象となるデバイス リビジョン : 詳細は、「(ザイリンクス アンサー 47916) - Zynq-7000 AP SoC シリコン リビジョンの相違点」を参照してください。


2013 年 1 月 : VRN/VRP で基準抵抗がサンプリングできるようにするには、DCI 操作に対して slcr.DDRIOB_DCI_CTRL.UPDATE_CONTROL を 0 に設定する必要があります。

アンサー レコード リファレンス

マスター アンサー レコード

Answer Number アンサータイトル 問題の発生したバージョン 修正バージョン
47916 Zynq-7000 AP SoC デバイス - シリコン リビジョン間の相違点 N/A N/A
AR# 47521
日付 02/19/2013
ステータス アクティブ
種類 デザイン アドバイザリ
デバイス
  • Zynq-7000
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