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AR# 54550

LogiCORE IP MIPI D-PHY - Vivado 2015.3 およびそれ以降のバージョンのリリース ノートおよび既知の問題

説明

このアンサーでは、MIPI D-PHY コアのリリース ノートおよび既知の問題を示します。次の情報が記載されています。

  • 一般情報
  • 既知の問題および修正された問題
  • 改訂履歴

LogiCORE MIPI D-PHY コア IP ページ:

https://japan.xilinx.com/products/intellectual-property/ef-di-mipi-csi-rx.html

ソリューション

一般情報

サポートされるデバイスは、次の 3 つの場所から確認できます。


各バージョンにおける新機能と追加されたデバイス サポートのリスト:

  • Subsystem または IP - Vivado に含まれるコアの変更ログ ファイルを参照。
  • Subsystem または IP - 下の変更ログのリンクをクリック。
  • スタンドアロン ソフトウェア ドライバー - ザイリンクス SDK に含まれる Doxygen ドライバーの変更ログを参照
  • スタンドアロン ソフトウェア ドライバー - Github ソフトウェア ドライバー リポジトリ


バージョン対照表

次の表に、コアの各バージョンに対して、それが最初に含まれた Vivado デザイン ツールのバージョンを示します。

コアのバージョンVivado のバージョン IP 変更ログIP パッチ
v4.12018.1(Xilinx Answer 70699)
v4.0 (Rev. 1)2017.4(Xilinx Answer 70386)(Xilinx Answer 70530)
v4.02017.3(Xilinx Answer 69903)(Xilinx Answer 70195)
v3.1 (Rev.1)2017.2(Xilinx Answer 69326)(Xilinx Answer 69760)
v3.12017.1(Xilinx Answer 69055)(Xilinx Answer 69273)
v3.0 (Rev. 1)2016.4(Xilinx Answer 68369)(Xilinx Answer 68810)
v3.02016.3(Xilinx Answer 68021)
v2.0 (Rev.1)2016.2(Xilinx Answer 67345)
v2.02016.1(Xilinx Answer 66930)
v1.02015.3(Xilinx Answer 65570)

一般的なガイダンス

次の表に、LogiCORE MIPI D-PHY コアを使用する際の一般的なガイダンスを含むアンサーを示します。

アンサー番号タイトル
(Xilinx Answer 71205)MIPI D-PHY TX を使用すると、DL*_TXREQUESTHS / CL_TXREQUESTHS を同時にアサート/ディアサートできるか
(Xilinx Answer 69530)MIPI D-PHY RX ライン レート設定のマージンについて
(Xilinx Answer 67249)高速データ通信までの最大スタートアップ時間について
(Xilinx Answer 66088)MIPI D-PHY v1.2 のサポートの予定について

既知の問題および修正された問題

次の表に、Vivado 2015.3 でリリースされた MIPI D-PHY コア v1.0 以降の既知の問題を示します。

注記: [問題の発生したバージョン] 列には、問題が最初に見つかったバージョンを示しています。

問題はそれ以前のバージョンでも発生していた可能性がありますが、以前のバージョンではそれを検証するテストは実行されていません。

アンサー番号タイトル問題の発生したバージョン修正バージョン
(Xilinx Answer 69531)MIPI DPHY RX をシミュレーションすると system_rst_in に対して「ncelab: *dphy_ip/mipi_dphy.srcs/sources_1/ip/mipi_dphy_rx1/mipi_dphy_rx1_core.v,436|49): implicit wire has no fanin」という警告メッセージが表示される v3.1v4.0
(Xilinx Answer 70591)MIPI D-PHY IP v4.0 の IDEALY タップ値をオンザフライで変更可能か (7 シリーズ デバイスをターゲットにした IP)v4.0v4.1
(Xilinx Answer 70581)UltraScale+ デバイスをターゲットにすると MIPI RX IP で SoT/ECC/CRC エラーが発生する v4.0 (Rev. 1)v4.1
(Xilinx Answer 70196)7 シリーズ デバイスでは自動キャリブレーションと外部 IDELAYCTRL があるときに 合成デザインで高速レーンが未接続のままになるv4.0v4.0 (Rev. 1)
(Xilinx Answer 69671)7 シリーズ デバイスを使用して MIPI D-PHY TX をインプリメントすると、HS から LP への伝送中に出力にオーバーシュートが見られるv3.1 (Rev.1)v4.0
(Xilinx Answer 69931)MIPI D-PHY TX を使用すると、HS-PREPARE の長さが MIPI D-PHY 仕様の v1.1 に違反するv3.1 (Rev.1)なし
(Xilinx Answer 69766)7 シリーズのデバイスで MIPI D-PHY TX を使用すると、レーン間の SoT 信号でスキューが発生するv3.1 (Rev.1)なし
(Xilinx Answer 67365)SoT パターンでレシーバー IP はどのように動作しますか。"BC" を送信すると "B8" を受信するエラーが発生するのはなぜですか。v2.0v3.0
(Xilinx Answer 69274)MIPI D-PHY Controller RX で ulpsactivenot が 1 クロック間しかアサートされないv3.1なし
(Xilinx Answer 69057)MIPI DPHY RX IP または MIPI CSI-2 RX サブシステムから SOTsynchs エラーが発生するv3.0 (Rev. )v3.1
(Xilinx Answer 68603)スレーブ モード (サンプル デザインの共有ロジック) の D-PHY RX IP で マスター モード (コアの共有ロジック) の D-PHY RX IP とリソースを共有すると機能しないv3.0 (Rev. 1)v3.1
(Xilinx Answer 68603)2016.4 にアップデートした後スレーブ IP が機能しない v3.0 (Rev. 1)3.0 (Rev. 1)なし
(Xilinx Answer 67296)MIPI D-PHY IP におけるマルチレーン ユース ケースのサポートについて v2.0なし
(Xilinx Answer 67258)高速モードでの受信時に rxvalidhs の動作が変更される理由v1.01.0v2.0

改訂履歴

06/08/2018(Xilinx Answer 71205) を追加
05/25/2018バージョン対照表に (Xilinx Answer 70530) を追加
2018/04/13(Xilinx Answer 69530) および (Xilinx Answer 69531) を追加
2018/04/04バージョン対照表に v4.1、(Xilinx Answer 70196)、(Xilinx Answer 70581)、および (Xilinx Answer 70591) を追加
2018/01/25(Xilinx Answer 69274) を追加
01/18/2018バージョン対照表に v4.0 (Rev. 1) を追加
2017/11/03(Xilinx Answer 69766)、(Xilinx Answer 69671)、(Xilinx Answer 69931)、および (Xilinx Answer 69760) を追加
2017/10/23バージョン対照表に v3.1 (Rev.1) および v4.0 を追加し、(Xilinx Answer 67365) を追加
2017/06/05(Xilinx Answer 69274) を追加
2017/04/05バージョン対照表に v3.1 を追加し、(Xilinx Answer 68803)、(Xilinx Answer 68810)、および (Xilinx Answer 69057) を追加
2017/02/07バージョン対照表に v2.0 (Rev.1)、v3.0 および v3.0 (Rev.1) を追加し、(Xilinx Answer 68603) を追加
2016/05/31(Xilinx Answer 67258)、(Xilinx Answer 67296)、および (Xilinx Answer 67249) を追加
2016/04/06バージョン表に v2.0 を追加
2015/12/07(Xilinx Answer 66088) を追加
2015/09/30初版

アンサー レコード リファレンス

マスター アンサー レコード

Answer Number アンサータイトル 問題の発生したバージョン 修正バージョン
56852 ザイリンクス マルチメディア、ビデオ、および画像ソリューション センター - 主な問題 N/A N/A

サブアンサー レコード

Answer Number アンサータイトル 問題の発生したバージョン 修正バージョン
66088 LogiCORE IP MIPI D-PHY - MIPI D-PHY v1.2 のサポート予定について N/A N/A
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69057 LogiCORE IP MIPI D-PHY v3.0 (Rev. 1) - MIPI DPHY RX IP または MIPI CSI-2 RX Subsystem から SOTSynchs エラーが生成されるのはなぜか N/A N/A
69173 2017.1 LogiCORE IP MIPI CSI-2 Transmitter Subsystem v1.0 (Rev. 2) - LogiCORE IP MIPI CSI-2 Transmitter Subsystem v1.0 (Rev. 2) のパッチ アップデート N/A N/A
69250 LogiCORE IP MIPI CSI-2 Transmitter Subsystem v1.0 (Rev. 2) - 一部のライン レートの設定について MIPI トランスミッターのクロック/データが中央揃えの関係にならない N/A N/A
69274 LogiCORE IP MIPI D-PHY v3.1, v3.1 (Rev. 1) および v4.0 (Rev. 1) - MIPI D-PHY RX で ulpsactivenot が 1 クロック間しかアサートされない N/A N/A
69530 LogiCORE MIPI D-PHY および MIPI CSI-2 RX Subsystem - MIPI D-PHY RX ライン レートの設定にはどれくらいのマージンがあるか N/A N/A
67365 LogiCORE IP MIPI D-PHY v2.0 - SoT パターンのレシーバー IP の予期動作と、BC を送信し、B8 を受信するとエラーがない理由 N/A N/A
69931 LogiCORE IP MIPI D-PHY v3.1 (Rev. 1) - MIPI D-PHY TX を使用すると HS-PREPARE の長さが MIPI D-PHY仕様 v1.1 に違反する N/A N/A
69766 LogiCORE IP MIPI D-PHY v3.1 (Rev. 1) - MIPI D-PHY TX を使用すると、レーン間の SoT 信号にスキューが見られる N/A N/A
69671 LogiCORE IP MIPI D-PHY v3.1 (Rev. 1) - 7 シリーズ デバイスを使用して MIPI D-PHY TX をインプリメントすると、HS から LP への伝送中に出力にオーバーシュートが見られる N/A N/A
69760 2017.2 MIPI D-PHY v3.1 (Rev. 1) - LogiCORE IP MIPI D-PHY v3.1 (Rev. 1) のパッチ アップデート N/A N/A
70196 LogiCORE IP MIPI D-PHY v4.0 - 7 シリーズ デバイスでは自動キャリブレーションと外部 IDELAYCTRL を使用する合成デザインで高速レーンが未接続のままになる N/A N/A
70581 LogiCORE IP MIPI D-PHY Controller v4.0 (rev.1) (または MIPI CSI-2 Receiver Subsystem v3.0 (Rev. 1)) - UltraScale+ デバイスをターゲットにすると MIPI RX IP で SoT/ECC/CRC エラーが発生する N/A N/A
70591 LogiCORE IP MIPI D-PHY v4.0 - MIPI D-PHY IP v4.0 の IDEALY タップ値をオンザフライで変更可能か(7 シリーズ デバイスをターゲットにした IP) N/A N/A
70530 2017.4 LogiCORE IP MIPI D-PHY v4.0 (rev.1) - MIPI D-PHY LogiCORE IP v4.0 (rev.1) のパッチ アップデート N/A N/A
69531 LogiCORE MIPI D-PHY v3.1, MIPI CSI-2 Rx Subsystem v2.2 (Rev. 1) - MIPI DPHY RX をシミュレーションしていると「ncelab: *dphy_ip/mipi_dphy.srcs/sources_1/ip/mipi_dphy_rx1/mipi_dphy_rx1_core.v,436|49): implicit wire has no fanin'' on system_rst_in」という警告メッセージが表示される N/A N/A
71205 LogiCORE IP MIPI D-PHY v4.0 - MIPI D-PHY TX を使用すると、DL*_TXREQUESTHS / CL_TXREQUESTHS を同時にアサート/ディアサートできるか N/A N/A

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AR# 54550
日付 06/11/2018
ステータス アクティブ
種類 リリース ノート
デバイス
  • Zynq UltraScale+ MPSoC
  • Kintex UltraScale+
  • Virtex UltraScale+
IP
  • MIPI D-PHY
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