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AR# 64761

UltraScale デバイスにおける Tandem PCIe およびパーシャル リコンフィギュレーションでの PCI Express リンクを介したビートストリームの読み込み

説明

このアンサーでは、Tandem PCIe またはパーシャル リコンフィギュレーション ソリューションでの PCI Express リンクを介したビットストリームの読み込みについて説明する PDF ファイルを提供しています。

また、関連ファイルが ZIP ファイルで提供されています。

提供されているビットストリーム読み込みのメカニズムは、UltraScale Architecture Gen3 Integrated Block for PCI Express コアに適用されます。 

このメカニズムを使用すると、MCAP を介して Tandem Stage 2 ビットストリームを配布し、ビットストリームをクリアし、Tandem コンフィギュレーションおよびパーシャル コンフィギュレーション デザイン用のパーシャル ビットストリームを配布できます。

7 シリーズ デバイスの PCI Express リンクを介した Tandem PCIe のセカンド ステージ ビットストリームの読み込みについては、(Xilinx Answer 51950) を参照してください。

ソリューション

このアンサーの最後に添付されている「Bitstream Loading across the PCI Express Link in UltraScale Devices for Tandem PCIe and Partial Reconfiguration」および関連デザイン ファイルをダウンロードしてください。

ファイル名 ：

  • Xilinx_Answer_64761_UltraScale_Devices.pdf
  • Xilinx_Answer_64761_Files.zip

改訂履歴

2015/06/30 - 初版
2015/10/06 - 「Tandem Field Update」セクションをアップデート

添付ファイル

関連添付ファイル

タイトル サイズ ファイルタイプ
Xilinx_Answer_64761_Files.zip 6 MB ZIP
Xilinx_Answer_64761__UltraScale_Devices.pdf 2 MB PDF
AR# 64761
日付 11/10/2015
ステータス アクティブ
種類 一般
IP
  • UltraScale FPGA Gen3 Integrated Block for PCI Express (PCIe)
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