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Vivado Design Suite のパーシャル リコンフィギュレーション

パーシャル リコンフィギュレーションは、パーシャル ビット ファイルをダウンロードしてロジック ブロックを動的に修正する機能で、ほかロジックは中断せずにそのまま保持できます。ザイリンクスのパーシャル リコンフィギュレーション テクノロジでは、動作中に機能を変更でき、リンク全体のリコンフィギュレーションと再確立が不要なため、FPGA が持つ柔軟性が劇的に高まります。パーシャル リコンフィギュレーションを使用することで、デバイス数を少なくしたり、小規模デバイスへ移行することができ、電力の削減とシステム強化が可能になります。必要なときにいつでも必要な機能をロードできるため、シリコンをより効果的に使用できます。

パーシャル リコンフィギュレーション ソフトウェア

Vivado® Design Suite 2013.3 から製品化されているこのソフトウェア アプローチは、2010 年に ISE® Design Suite でリリースされた最強ソリューションをベースに構築されています。FPGA 全体の動作を継続したまま、一部分をリコンフィギュレーションするために、ソフトウェア ツールが機能のロックを解除します。この最新ソリューションは、Vivado Design Suite の優れたインプリメンテーション機能を利用します。ユーザーは Tcl ベースの非プロジェクト フローでデザインを実装できます。また Vivado IDE 内では RTL ベースのデザインがプロジェクト モードでサポートされ、多くの基本フローが自動的に管理されます。

設計者がパーシャル リコンフィギュレーションの設計をより迅速かつ簡単に行えるように、2 つのコアを提供しています。 Partial Reconfiguration Controller IP は、ハードウェア ベースのコンフィギュレーション コントローラーであり、トリガーやアービトレーションからビットストリーム作成やエラー処理に至るまで、リコンフィギュレーション イベントに関するすべての側面を管理できます。  Partial Reconfiguration Decoupler IP は、PR Controller またはその他のカスタマー コントローラーと併用され、リコンフィギュレーションされるダイナミック領域を安全に分離することができます。

パーシャル リコンフィギュレーションは、Vivado Design Suite HLx System および Design Editions に追加費用なしで含まれています。WebPack には、このパーシャル リコンフィギュレーション機能を低コストで購入して追加できます。価格および注文の詳細は、販売代理店にお問い合わせください。

主な機能と利点

優れた作業環境

  • Vivado IDE は、HDL からビットストリーム生成までの Tcl ベースの非プロジェクト フローと RTL プロジェクト フローをサポート
  • スタティック/リコンフィギャブル モジュールのデータベースを効率的に管理
  • 不完全なモジュールを削除できるブラックボックス ビットストリームをサポート

ユーザー制御

  • ユーザーがリコンフィギャブル モジュールの変形を管理する方法を判断
  • モジュールが追加/削除される間、メモリ内でスタティック デザインをオープンにする
  • Floorplan 機能で、再コンフィギュレーションされるリソースを判断

下位レベルの詳細はソフトウェアで判断

  • ツールがパーティション インターフェイスを自動管理 (オーバーヘッドが不要)
  • デザイン ルール チェック (DRC) がデザイン構造やコンフィギュレーションを検証
  • 標準のタイミング クロージャー技術が適用される

パーシャル リコンフィギュレーションは、Vivado® Design Suite HLx System および Design Editions に追加費用なしで含まれています。WebPack には、このパーシャル リコンフィギュレーション機能を低コストで購入して追加できます。

最小デバイスを除くほとんどの 7 シリーズおよび Zynq®-7000 デバイスはパーシャル リコンフィギュレーションをサポートしています。Vivado Design Suite は UltraScale™ を完全にサポートし、すべてのデバイスでビットストリーム生成まで可能です。VU440 の使用についてはザイリンクス販売代理店にお問い合わせください。現在、UltraScale+™ デバイスのサポートは、10 のプロダクション デバイスと 8 つのベータ版が対象です。

UltraScale は、パーシャル リコンフィギュレーション技術に新たな進化をもたらし、ほとんどすべての FPGA リソース タイプ (I/O、ギガビット トランシーバー、クロッキング ネットワークなど) のリコンフィギュレーションを可能にします。

大学関連の教授および研究員の方は、ザイリンクス ユニバーシティ プログラム (XUP) からライセンスを取得できます。 ライセンス取得に必要な要件および手続きの詳細は、こちらをご覧ください。

トレーニング コース

ザイリンクスの FPGA およびエンベデッド デザイン トレーニングは、今すぐ設計をスタートするために必要な基礎知識が身につくハンズオン コースを提供しています。このプログラムは、FPGA テクノロジを使用し始めたばかりの設計者および複雑なコネクティビティ、デジタル信号処理またはエンベデッド ソリューションなどの開発に携わる、FPGA 設計の経験者すべてを対象としています。トレーニング クレジットに関する詳細は、お近くの販売代理店へお問い合わせください。 詳細

Vivado QuickTake ビデオ チュートリアル

ザイリンクスは、ISE ソフトウェア ツールから Vivado® Design Suite への移行において、ユーザーに役立つ情報を提供する QuickTake ビデオ チュートリアルを展開しています。Vivado® Design Suite は、全く新しいタイプのソリューションであるため、従来の技術知識に頼ることはできません。ザイリンクスは、ユーザー ガイドを熟読、またはソフトウェア対話形式のチュートリアルを実行する十分な時間のない方のために、学習効率のよいビデオ チュートリアルを提供しています。 詳細