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コネクティビティ

ザイリンクス コネクティビティ プラットフォームによる一連のスペクトラム - つまり、メインストリーム製品からハイエンド製品まで - にわたる最終製品のシステムを最短期間で展開できるようになり、アプリケーション設計に大きな利益をもたらします。

コネクティビティ プラットフォームの利点

  • 最大 8 個の GTP 3.125Gbps トランシーバーを搭載した Spartan®-6 FPGA は、オートモーティブ インフォテイメント システムや高解像度ディスプレイなど、量産電子機器で求められるコスト、使いやすさ、そして低消費電力の要件を満たします。
  • 最大 36 個の GTX 6.5Gbps トランシーバーを搭載し、高速プロトコル (Interlaken や PCIe® 2.0 など) の要件を十分に満たすパフォーマンス マージンを持つ Virtex®-6 LXT および SXT FPGA は、ワイヤレス ベース ステーション、スイッチ、そしてルータなどのマルチ プロトコル システムやプロフェッショナルな用途向けビデオ機器に最適です。
  • 最大 72 個のシリアル IO チャンネル (48 個の GTX と 24 個 の 11+ Gbps GTH) トランシーバーを搭載した Virtex-6 HXT FPGA は、40G/100G アプリケーションに外部物理レイヤ (PHY) を使用するソリューションと比較して、トランシーバーの消費電力を 80% 以上抑えることができます。
    • これには、ワイヤード通信、高機能データ暗号化エンジン、最先端の医療画像処理、およびデジタル ビデオ制作、編集、放送機器用のトランスポンダ/マックスポンダ、トラフィック マネージャ、およびパケット プロセッシングが含まれます。
  • AXI4 インターコネクト規格をサポートしているため、システム設計者は、最高 Fmax、最大スループット、低レイテンシ、省エリアなど、これらの要因すべて、あるいは一部においてデザインを最適化できます。
  • ISE® Design Suite ソフトウェア に統合された最新鋭のシリアル コネクティビティ ツール
  • 確立された、あるいは最先端で定義中のプロトコルの両方をインプリメント可能
  • 業界をリードするシリアル プロトコルを含む、包括的な IP ポートフォリオ
  • AXI4 インターコネクト規格を使用した場合、異なるメーカーが提供する複数 IP の統合において、複数のレガシ/カスタム インターフェイスを使用する必要がなくなります。
  • コネクティビティ向けのザイリンクス ターゲット デザイン プラットフォームに含まれるインフラストラクチャ構築ブロックを活用し、製品差別化に専念
  • FPGA メザニン カード (FMC) コネクタを含む、スケーラブルなボード ストラテジを活用して評価、プロトタイプ作成、設計、およびデバッグを迅速化
  • 設計を開始して評価を始めてください、そしてザイリンクスのコネクティビティ ターゲット リファレンス デザインを更新してください。 ターゲット リファレンス デザインはすべてのキットとともに提供され ISE Design Suite のリリースごとに更新されます。

ザイリンクス コネクティビティ デザイン プラットフォーム

Kintex®-7 および Virtex®-6 FPGA コネクティビティ キット

  • シリアル/パラレル プロトコル デザインの迅速な展開
  • 業界プロトコルをサポートする幅広い IP ポートフォリオ
  • AXI4 インターコネクト対応による柔軟性と生産性が向上

ISE® Design Suite および AXI4 インターコネクト対応のターゲット リファレンス デザインを利用して開発期間を短縮

コネクティビティ プラットフォーム エレメンツ

  • 統合された 28Gb/s シリアル トランシーバーを搭載した Virtex-7 HT デバイスは、最大 16 個 x 28 Gb/s のシリアル トランシーバ―を使用して、超高帯域アプリケーション用に業界初 2.8Tb/s のシリアル バンド幅を実現できます。これらのデバイスは、CFP2 オプティカル インターフェイスを備えた次世代 100G、nx100G、および 400G ライン カード向けに最適化されています。
  • Virtex-7 T デバイスは、シングル デバイスに最大 200 万ロジック セル、68億個のトランジスタ、12.5Gb/s シリアル トランシーバーを搭載し、ASIC のプロトタイピング、エミュレーション、およびリプレースメントを可能にする業界最高レベルの容量と性能を提供します。
  • Virtex-7 XT デバイスは、高性能トランシーバー、DSP、および BRAM を備えて最も高いプロセッシング バンド幅を提供し、最大 96 個の 10G Base KR バックプレーン対応シリアル トランシーバーを搭載しています。
  • 最大 72 のシリアル I/O チャンネル (24 GTH や 48 GTX トランシーバー) を搭載した Virtex-6 HXT FPGA は、1 つの FPGA の 40G/100G アプリケーション を設計するのに 0.5Tb/s 以上のシリアル I/O バンド幅を提供します。
    • 組み合わせた場合、select I/O バンド幅、総合 I/O バンド幅は 1Tbps 以上となります。
  • Virtex-6 LXT と SXT FPGA は GTX トランシーバーを提供します。
    • あらゆるFPGAの中で最も柔軟なトランシーバー
    • 多彩なシリアル プロトコルで設計が可能
    • 使用法を簡潔化する、業界の中で最良なハードウェア PCS 機能
    • 高速なデバッグに対応、そして全アプリケーションに適用される複雑なシリアル プロトコルの採用を迅速化
  • Spartan-6 LXT FPGA は、GTP シリアル トランシーバーを搭載した最も低コストな FPGA
    • 最も一般的なシリアル規格 : PCI Express®, Gigabit Ethernet, Display Port などに、完全に対応するため最適化
    • 高効率で専用のクロッキング ソースを使って、各 GTP トランシーバーが個別のシリアル プロトコルに対応するよう設定可能
  • すべての Xilinx Virtex-6 および Spartan-6 FPGAは、コンフィギュレーション可能な SelectIO™ テクノロジを活用し複数電圧、複数規格パラレル コネクティビティ テクノロジ (HSTL、LVDS (SDR および DDR) など) をサポート

ISE Design Suiteは、コネクティビティ デザイン向けの完全ソリューションであり、デザインの差別化、製品化までの時間短縮、最高性能の実現、電力とコストの削減に取り組み、より高い生産性を達成するために必要な包括的な手法および IP を提供します。

Logic Edition は、デザイン入力、合成、インプリメンテーション、そして検証のためのザイリンクス専用のツールとテクノロジを含み、短期間での最適なデザイン結果を実現します。

完全な高速シリアル デザイン メソドロジとツール フロー

  • デザイン ツール : ISE Design Suite Logic Edition
    • アーキテクチャ ウィザード - トランシーバー、クロッキング、CRC ウィザード
    • デザインの分析と合成 - PlanAhead™ (FloorPlanning と PinLayout)、XST
    • インプリメンテーション ツール - MAP、タイミング ドリブン P&R、SmartXplorer
    • デバッグ ツール - ChipScope™ Pro、SerialIO ToolKit、FPGA Editor、IBERT LogiCORE™
  • ガイドラインとレポート
    • シグナル インテグリティ
    • トランシーバーの特性全般とプロトコル固有レポート
  • 技術資料
    • データシートとユーザー ガイド
    • ホワイト ペーパー
    • アプリケーション ノート
    • リファレンス デザイン

Serial Rapid IOザイリンクスは、シリアルとパラレル プロトコルに対応する End-to-End コネクティビティ を提供します。. これらプロトコルへのサポートの多くは、デザインの柔軟性を最大にし、リスクを削減する Xilinx IP LogiCORE から入手できます。さらにこれらのプロトコルは、シリアル I/O 規格のために前もって検証され、業界全般の IP 相互運用性と認定プログラムで認証されます。 すべての Xilinx IP は、CORE Generator™ システムから提供され、デザイン プロセスの簡素化、そしてデザイン クオリティの向上を促進させます。

プロトコルとテクノロジのザイリンクス サポート

ユーザー モデル別
バックプレーン ボックス間 チップ間
イーサネット イーサネット Aurora
OBSAI HD-SDI CAN
CPRI SONET/ SDH OC-3 to OC-768 Interlaken
PCI Express   PCI Express
Serial Rapid IO   Serial Rapid IO
    SFi-S
    SPAUI
    SPI3
    SPI4.2
     
マーケット セグメント別
航空宇宙/防衛 オーディオ ビデオ ブロードキャスト オートモーティブ
Aurora Aurora CAN
PCI Express DisplayPort  
Serial Rapid IO イーサネット  
SPI4.2 PCI Express  
     
コンピューティング 産業/医療機器 ワイヤード通信
PCI Express イーサネット Aurora
Serial Rapid IO PCI Express イーサネット
  Serial Rapid IO Interlaken
    PCI Express
    SPI3
    SPI4.2

詳細については、AXI4 インターフェイス プロトコルのサポートがエンベデッド FPGA デザインにもたらす生産性、柔軟性、そしてアベイラビリティをご覧ください。

認定事項

  • ザイリンクスは、 UNH 検証済みのイーサネット IP コアに統合されたシリアル インターフェースを提供し、初めてのタスク実行における成功を保証します。
  • 最先端のフレーマー (e.g. PMC, Vitesse) と NPU (e.g. Netronome IXP2800) で SPI-4.2 コア 相互運用性テスト済み
  • PCI Express 用のすべての PCI-SIG 特定コンプライアンス テストに合格し、 PCI-SIG インテグレータ リストに掲載

追加 IP はザイリンクス IP センタから入手可能

ザイリンクスの評価キットは、完全なコネクティビティ デザイン環境を提供し、ザイリンクス FPGA を対象としたアプリケーションに必要となるクリティカルなコンポーネントを統合することで迅速なデザイン開発を可能にします。

FPGA デザイン インプリメンテーションのプロトタイプ作成、評価、およびデバッグ用の開発キット

ターゲット リファレンス デザインで迅速なデザイン開発

  • コネクティビティ キットで提供
  • デザイン フレームワーク
    • システム環境で動作する重要なコンポーネントのデモ
  • ISE Design Suite でデザインを保持および修正
  • 完全なサポート
  • ザイリンクスとサード パーティの IP コアを統合
  • 設計/ハードウェアで評価キットの機能性を拡張

主なアライアンス メンバー